參數(shù)資料
型號(hào)： PIC18LF6310-I/PT
廠商： Microchip Technology
文件頁數(shù)： 292/411頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 4KX16 64TQFP
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 160
系列： PIC® 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 40MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，HLVD，POR，PWM，WDT
輸入/輸出數(shù)： 54
程序存儲(chǔ)器容量： 8KB（4K x 16）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 768 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 12x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-TQFP
包裝： 托盤
產(chǎn)品目錄頁面： 642 (CN2011-ZH PDF)
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2010-2012 Microchip Technology Inc.
DS39977F-page 361
PIC18F66K80 FAMILY
23.2.2
A/D RESULT REGISTERS
The ADRESH:ADRESL register pair is where the 12-bit
A/D result and extended sign bits (ADSGNx) are
loaded at the completion of a conversion. This register
pair is 16 bits wide. The A/D module gives the flexibility
of left or right justifying the 12-bit result in the 16-bit
result register. The A/D Format Select bit (ADFM) con-
trols this justification.
Figure 23-3 shows the operation of the A/D result
justification and the location of the sign bit (ADSGNx).
The extended sign bits allow for easier 16-bit math to
be performed on the result. The results are
represented as a two's compliment binary value. This
means that when sign bits and magnitude bits are
considered together in right justification, the ADRESH
and ADRESL registers can be read as a single signed
integer value.
When the A/D Converter is disabled, these 8-bit
registers can be used as two general purpose
registers.
FIGURE 23-3:
A/D RESULT JUSTIFICATION
Result bits
ADSGN bit
ADRESH
ADRESL
ADRESH
ADRESL
12-Bit Result
Left Justified
ADFM = 0
Right Justified
ADFM = 1
Two’s Complement Example Results Number Line
Left Justified
Right Justified
Hex
Decimal
Hex
Decimal
0xFFF0
4095
0x0FFF
4095
0xFFE0
4094
0x0FFE
4094
……
…
0x0020
2
0x0002
2
0x0010
1
0x0001
1
0x0000
0
0x0000
0
0xFFFF
-1
0xFFFF
-1
0xFFEF
-2
0xFFFE
-2
……
…
0x001F
-4095
0xF001
-4095
0x000F
-4096
0xF000
-4096
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