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參數(shù)資料
| 型號： | PIC18F86J60 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 64/80/100-Pin, High-Performance, 1 Mbit Flash Microcontrollers with Ethernet |
| 中文描述： | 64/80/100-Pin，高性能，1兆位閃存微控制器與以太網(wǎng) |
| 文件頁數(shù)： | 321/474頁 |
| 文件大?。?/td> | 3834K |
| 代理商： | PIC18F86J60 |
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2006 Microchip Technology Inc.
Advance Information
DS39762A-page 319
PIC18F97J60 FAMILY
20.3
EUSARTx Synchronous
Master Mode
The Synchronous Master mode is entered by setting
the CSRC bit (TXSTAx<7>). In this mode, the data is
transmitted in a half-duplex manner (i.e., transmission
and reception do not occur at the same time). When
transmitting data, the reception is inhibited and vice
versa. Synchronous mode is entered by setting bit
SYNC (TXSTAx<4>). In addition, enable bit, SPEN
(RCSTAx<7>), is set in order to configure the TXx and
RXx pins to CKx (clock) and DTx (data) lines,
respectively.
Clock polarity (CKx) is selected with the TXCKP bit
(BAUDCON<4>). Setting TXCKP sets the Idle state on
CKx as high, while clearing the bit sets the Idle state as
low. Data polarity (DTx) is selected with the RXDTP bit
(BAUDCONx<5>). Setting RXDTP sets the Idle state
on DTx as high, while clearing the bit sets the Idle state
as low. DTx is sampled when CKx returns to its Idle
state. This option is provided to support Microwire
devices with this module.
20.3.1
EUSARTx SYNCHRONOUS
MASTER TRANSMISSION
The EUSARTx transmitter block diagram is shown in
Figure 20-3. The heart of the transmitter is the Transmit
(Serial) Shift Register (TSR). The Shift register obtains
its data from the Read/Write Transmit Buffer register,
TXREGx. The TXREGx register is loaded with data in
software. The TSR register is not loaded until the last
bit has been transmitted from the previous load. As
soon as the last bit is transmitted, the TSR is loaded
with new data from the TXREGx (if available).
Once the TXREGx register transfers the data to the
TSR register (occurs in one T
CY
), the TXREGx is empty
and the TXxIF flag bit is set. The interrupt can be
enabled or disabled by setting or clearing the interrupt
enable bit, TXxIE. TXxIF is set regardless of the state
of enable bit TXxIE; it cannot be cleared in software. It
will reset only when new data is loaded into the
TXREGx register.
While flag bit TXxIF indicates the status of the TXREGx
register, another bit, TRMT (TXSTAx<1>), shows the
status of the TSR register. TRMT is a read-only bit which
is set when the TSR is empty. No interrupt logic is tied to
this bit, so the user must poll this bit in order to determine
if the TSR register is empty. The TSR is not mapped in
data memory so it is not available to the user.
To set up a Synchronous Master Transmission:
1.
Initialize the SPBRGHx:SPBRGx registers for the
appropriate baud rate. Set or clear the BRG16
bit, as required, to achieve the desired baud rate.
Enable the synchronous master serial port by
setting bits SYNC, SPEN and CSRC.
If the signal from the CKx pin is to be inverted,
set the TXCKP bit. If the signal from the DTx pin
is to be inverted, set the RXDTP bit.
If interrupts are desired, set enable bit TXxIE.
If 9-bit transmission is desired, set bit TX9.
Enable the transmission by setting bit TXEN.
If 9-bit transmission is selected, the ninth bit
should be loaded in bit TX9D.
Start transmission by loading data to the
TXREGx register.
If using interrupts, ensure that the GIE and PEIE
bits in the INTCON register (INTCON<7:6>) are
set.
2.
3.
4.
5.
6.
7.
8.
9.
FIGURE 20-11:
SYNCHRONOUS TRANSMISSION
bit 0
bit 1
Word 1
bit 7
Q1Q2 Q3Q4 Q1Q2Q3 Q4Q1Q2Q3Q4 Q1Q2Q3Q4Q1Q2 Q3 Q4
Q3Q4 Q1Q2Q3 Q4 Q1Q2 Q3Q4 Q1Q2 Q3 Q4 Q1Q2 Q3Q4Q1Q2 Q3Q4Q1Q2 Q3 Q4
bit 2
bit 0
bit 1
bit 7
RC7/RX1/DT1
RC6/TX1/CK1 pin
(TXCKP =
0
)
Write to
TXREG1 Reg
TX1IF bit
(Interrupt Flag)
TXEN bit
‘
1
’
‘
1
’
Word 2
TRMT bit
Write Word 1
Write Word 2
Note:
Sync Master mode, SPBRG1 =
0
, continuous transmission of two 8-bit words. This example is equally applicable to EUSART2
(RG1/TX2/CK2 and RG2/RX2/DT2).
RC6/TX1/CK1 pin
(TXCKP =
1
)
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| PIC18F86J65-I/PT | 功能描述:8位微控制器 -MCU 96KB FL 12KB RAM 10BASE-T RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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