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參數(shù)資料
| 型號： | PIC18F67J60T |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 64/80/100-Pin, High-Performance, 1 Mbit Flash Microcontrollers with Ethernet |
| 中文描述： | 64/80/100-Pin，高性能，1兆位閃存微控制器與以太網(wǎng) |
| 文件頁數(shù)： | 333/474頁 |
| 文件大小： | 3834K |
| 代理商： | PIC18F67J60T |
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2006 Microchip Technology Inc.
Advance Information
DS39762A-page 331
PIC18F97J60 FAMILY
21.2
Selecting and Configuring
Automatic Acquisition Time
The ADCON2 register allows the user to select an
acquisition time that occurs each time the GO/DONE
bit is set.
When the GO/DONE bit is set, sampling is stopped and
a conversion begins. The user is responsible for ensur-
ing the required acquisition time has passed between
selecting the desired input channel and setting the
GO/DONE bit. This occurs when the ACQT2:ACQT0
bits (ADCON2<5:3>) remain in their Reset state (‘
000
’)
and is compatible with devices that do not offer
programmable acquisition times.
If desired, the ACQT bits can be set to select a
programmable acquisition time for the A/D module.
When the GO/DONE bit is set, the A/D module continues
to sample the input for the selected acquisition time, then
automatically begins a conversion. Since the acquisition
time is programmed, there may be no need to wait for an
acquisition time between selecting a channel and setting
the GO/DONE bit.
In either case, when the conversion is completed, the
GO/DONE bit is cleared, the ADIF flag is set and the
A/D begins sampling the currently selected channel
again. If an acquisition time is programmed, there is
nothing to indicate if the acquisition time has ended or
if the conversion has begun.
21.3
Selecting the A/D Conversion
Clock
The A/D conversion time per bit is defined as T
AD
. The
A/D conversion requires 11 T
AD
per 10-bit conversion.
The source of the A/D conversion clock is software
selectable.
There are seven possible options for T
AD
:
2 T
OSC
4 T
OSC
8 T
OSC
16 T
OSC
32 T
OSC
64 T
OSC
Internal RC Oscillator
For correct A/D conversions, the A/D conversion clock
(T
AD
) must be as short as possible but greater than the
minimum T
AD
. See A/D parameter 130, Table 27-27
(
“A/D Conversion Requirements”
) for more information.
Table 21-1 shows the resultant T
AD
times derived from
the device operating frequencies and the A/D clock
source selected.
TABLE 21-1:
T
AD
vs. DEVICE OPERATING
FREQUENCIES
21.4
Configuring Analog Port Pins
The ADCON1, TRISA, TRISF and TRISH registers
control the operation of the A/D port pins. The port pins
needed as analog inputs must have their correspond-
ing TRIS bits set (input). If the TRIS bit is cleared
(output), the digital output level (V
OH
or V
OL
) will be
converted.
The A/D operation is independent of the state of the
CHS3:CHS0 bits and the TRIS bits.
AD Clock Source (T
AD
)
Maximum
Device
Frequency
Operation
ADCS2:ADCS0
2 T
OSC
4 T
OSC
8 T
OSC
16 T
OSC
32 T
OSC
64 T
OSC
RC
(2)
000
100
2.68 MHz
5.71 MHz
11.43 MHz
22.86 MHz
41.67 MHz
41.67 MHz
1.00 MHz
(1)
001
101
010
110
x11
Note 1:
The RC source has a typical T
AD
time of
4 ms.
See parameter 130 in Table 27-27 for A/D
RC clock specifications.
2:
Note 1:
When reading the PORT register, all pins
configured as analog input channels will
read as cleared (a low level). Pins config-
ured as digital inputs will convert an
analog input. Analog levels on a digitally
configured input will be accurately
converted.
2:
Analog levels on any pin defined as a
digital input may cause the digital input
buffer to consume current out of the
device’s specification limits.
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PDF描述 |
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