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參數(shù)資料
| 型號： | PIC18F24J11-I/SO |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 8/32頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PIC MCU FLASH 16K 2V 28-SOIC |
| 產(chǎn)品培訓(xùn)模塊： | XLP Deep Sleep Mode PIC18 J Series MCU Overview 8-bit PIC® Microcontroller Portfolio |
| 標(biāo)準(zhǔn)包裝： | 27 |
| 系列： | PIC® XLP™ 18F |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 48MHz |
| 連通性： | I²C，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 16 |
| 程序存儲器容量： | 16KB（8K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 3.8K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.15 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 10x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 28-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 656 (CN2011-ZH PDF) |
| 配用： | XLT28SO-1-ND - SOCKET TRANSITION 28SOIC 300MIL AC164332-ND - MODULE SKT FOR 28SOIC 18F45J10 |
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PIC18F2XJXX/4XJXX FAMILY
DS39687E-page 16
2009 Microchip Technology Inc.
4.0
READING THE DEVICE
4.1
Read Code Memory
Code memory is accessed one byte at a time via the
4-bit command, ‘1001’ (table read, post-increment).
The contents of memory pointed to by the Table Pointer
(TBLPTRU:TBLPTRH:TBLPTRL) are serially output on
PGD.
The 4-bit command is shifted in LSb first. The read is
executed during the next 8 clocks, then shifted out on
PGD during the last 8 clocks, LSb to MSb. A delay of
P6 must be introduced after the falling edge of the 8th
PGC of the operand to allow PGD to transition from an
input to an output. During this time, PGC must be held
low (see Figure 4-1). This operation also increments
the Table Pointer by one, pointing to the next byte in
code memory for the next read.
This technique will work to read any memory in the
000000h to 3FFFFFh address space, so it also applies
to reading the Configuration registers.
TABLE 4-1:
READ CODE MEMORY SEQUENCE
FIGURE 4-1:
TABLE READ, POST-INCREMENT INSTRUCTION TIMING (1001)
4-Bit
Command
Data Payload
Core Instruction
Step 1: Set Table Pointer.
0000
0E <Addr[21:16]>
6E F8
0E <Addr[15:8]>
6E F7
0E <Addr[7:0]>
6E F6
MOVLW Addr[21:16]
MOVWF TBLPTRU
MOVLW <Addr[15:8]>
MOVWF TBLPTRH
MOVLW <Addr[7:0]>
MOVWF TBLPTRL
Step 2: Read memory and then shift out on PGD, LSb to MSb.
1001
00 00
TBLRD *+
1
234
PGC
P5
PGD
PGD = Input
Shift Data Out
P6
PGD = Output
56
7
8
12
3
4
P5A
9
10 11
13
15 16
14
12
Fetch Next 4-Bit Command
10
0
1
PGD = Input
LSb
MSb
12
34
56
12
3
4
nn
n
P14
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