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  • 參數(shù)資料
    型號(hào): PIC17C43
    廠商: Microchip Technology Inc.
    英文描述: High-Performance 8-Bit CMOS EPROM/ROM Microcontroller(每個(gè)I/O口有20mA吸收,35mA驅(qū)動(dòng),4K位EPROM微控制器)
    中文描述: 高性能的8位CMOS存儲(chǔ)器/ ROM的微控制器(每個(gè)的I / O口有20mA的吸收,35毫安驅(qū)動(dòng),4K的位存儲(chǔ)器微控制器)
    文件頁數(shù): 110/241頁
    文件大?。?/td> 1548K
    代理商: PIC17C43
    第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁當(dāng)前第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁
    PIC17C4X
    DS30412B-page 110
    1996 Microchip Technology Inc.
    TABLE 15-2: PIC17CXX INSTRUCTION SET
    Mnemonic,
    Operands
    Description
    Cycles
    16-bit Opcode
    Status
    Affected
    Notes
    MSb
    LSb
    BYTE-ORIENTED FILE REGISTER OPERATIONS
    ADDWF
    f,d
    ADD WREG to f
    1
    0000 111d
    ffff
    ffff
    OV,C,DC,Z
    ADDWFC
    f,d
    ADD WREG and Carry bit to f
    1
    0001 000d
    ffff
    ffff
    OV,C,DC,Z
    ANDWF
    f,d
    AND WREG with f
    1
    0000 101d
    ffff
    ffff
    Z
    CLRF
    f,s
    Clear f, or Clear f and Clear WREG
    1
    0010 100s
    ffff
    ffff
    None
    3
    COMF
    f,d
    Complement f
    1
    0001 001d
    ffff
    ffff
    Z
    CPFSEQ
    f
    Compare f with WREG, skip if f = WREG
    1 (2)
    0011 0001
    ffff
    ffff
    None
    6,8
    CPFSGT
    f
    Compare f with WREG, skip if f > WREG
    1 (2)
    0011 0010
    ffff
    ffff
    None
    2,6,8
    CPFSLT
    f
    Compare f with WREG, skip if f < WREG
    1 (2)
    0011 0000
    ffff
    ffff
    None
    2,6,8
    DAW
    f,s
    Decimal Adjust WREG Register
    1
    0010 111s
    ffff
    ffff
    C
    3
    DECF
    f,d
    Decrement f
    1
    0000 011d
    ffff
    ffff
    OV,C,DC,Z
    DECFSZ
    f,d
    Decrement f, skip if 0
    1 (2)
    0001 011d
    ffff
    ffff
    None
    6,8
    DCFSNZ
    f,d
    Decrement f, skip if not 0
    1 (2)
    0010 011d
    ffff
    ffff
    None
    6,8
    INCF
    f,d
    Increment f
    1
    0001 010d
    ffff
    ffff
    OV,C,DC,Z
    INCFSZ
    f,d
    Increment f, skip if 0
    1 (2)
    0001 111d
    ffff
    ffff
    None
    6,8
    INFSNZ
    f,d
    Increment f, skip if not 0
    1 (2)
    0010 010d
    ffff
    ffff
    None
    6,8
    IORWF
    f,d
    Inclusive OR WREG with f
    1
    0000 100d
    ffff
    ffff
    Z
    MOVFP
    f,p
    Move f to p
    1
    011p pppp
    ffff
    ffff
    None
    MOVPF
    p,f
    Move p to f
    1
    010p pppp
    ffff
    ffff
    Z
    MOVWF
    f
    Move WREG to f
    1
    0000 0001
    ffff
    ffff
    None
    MULWF
    f
    Multiply WREG with f
    1
    0011 0100
    ffff
    ffff
    None
    9
    NEGW
    f,s
    Negate WREG
    1
    0010 110s
    ffff
    ffff
    OV,C,DC,Z
    1,3
    NOP
    No Operation
    1
    0000 0000
    0000
    0000
    None
    RLCF
    f,d
    Rotate left f through Carry
    1
    0001 101d
    ffff
    ffff
    C
    RLNCF
    f,d
    Rotate left f (no carry)
    1
    0010 001d
    ffff
    ffff
    None
    RRCF
    f,d
    Rotate right f through Carry
    1
    0001 100d
    ffff
    ffff
    C
    RRNCF
    f,d
    Rotate right f (no carry)
    1
    0010 000d
    ffff
    ffff
    None
    SETF
    f,s
    Set f
    1
    0010 101s
    ffff
    ffff
    None
    3
    SUBWF
    f,d
    Subtract WREG from f
    1
    0000 010d
    ffff
    ffff
    OV,C,DC,Z
    1
    SUBWFB
    f,d
    Subtract WREG from f with Borrow
    1
    0000 001d
    ffff
    ffff
    OV,C,DC,Z
    1
    SWAPF
    f,d
    Swap f
    1
    0001 110d
    ffff
    ffff
    None
    TABLRD
    Legend: Refer to Table 15-1 for opcode field descriptions.
    Note 1: 2’s Complement method.
    2: Unsigned arithmetic.
    3: If s = '1', only the file is affected: If s = '0', both the WREG register and the file are affected; If only the Working
    register (WREG) is required to be affected, then f = WREG must be specified.
    4: During an
    LCALL
    , the contents of PCLATH are loaded into the MSB of the PC and
    kkkk kkkk
    is loaded into
    the LSB of the PC (PCL)
    5: Multiple cycle instruction for EPROM programming when table pointer selects internal EPROM. The instruc-
    tion is terminated by an interrupt event. When writing to external program memory, it is a two-cycle instruc-
    tion.
    6: Two-cycle instruction when condition is true, else single cycle instruction.
    7: Two-cycle instruction except for
    TABLRD
    to PCL (program counter low byte) in which case it takes 3 cycles.
    8: A “skip” means that instruction fetched during execution of current instruction is not executed, instead an
    NOP is executed.
    9: These instructions are not available on the PIC17C42.
    t,i,f
    Table Read
    2 (3)
    1010 10ti
    ffff
    ffff
    None
    7
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