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參數(shù)資料
| 型號： | PIC16LF1508-E/P |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 72/123頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 8BIT 7KB FLASH 20-PDIP |
| 標(biāo)準(zhǔn)包裝： | 22 |
| 系列： | PIC® XLP™ 16F |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | I²C，LIN，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 17 |
| 程序存儲器容量： | 7KB（4K x 14） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 256 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 12x10b，D/A 1x5b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 20-DIP（0.300"，7.62mm） |
| 包裝： | 管件 |
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Micrel, Inc.
KSZ8873MLLJ
September 2011
52
M9999-091911-1.8
Register 6 (0x06): Global Control 4
Bit
Name
R/W
Description
Default
7
Reserved
RO
Reserved
Do not change the default values.
0
6
Port 3 Duplex
Mode
Selection
R/W
=1, Enable Port 3 MII to half-duplex mode.
=0, Enable Port 3 MII to full-duplex mode.
0
Pin P1LED0 strap
option.
Pull-up(1): Half -duplex
mode
Pull-down(0): Full-
duplex mode (default)
Note: P1LED0 has
internal pull-down.
5
Port 3 Flow
Control Enable
R/W
=1, Enable full duplex flow control on Switch port 3 MII interface.
=0, Disable full duplex flow control on Switch port 3 MII interface.
1
Pin P1LED1 strap
option.
Pull- up(1): Enable
flow control
Pull-down(0): Disable
flow control
Note: P1LED1 has
internal pull-up.
4
Port 3 Speed
selection
R/W
=1, The port 3 MII switch interface is in 10Mbps mode
=0, The port 3 MII switch interface is in 100Mbps mode
0
Pin P3SPD strap
option.
Pull-up(1): Enable
10Mbps
Pull-down(0): Enable
100Mbps (default)
Note: P3SPD has
internal pull-down.
3
Null VID
Replacement
R/W
=1, Will replace NULL VID with port VID (12 bits)
=0, No replacement for NULL VID
0
2-0
Broadcast
Storm
Protection
Rate
(1)
Bit [10:8]
R/W
This register along with the next register determines how many “64
byte blocks” of packet data are allowed on an input port in a preset
period. The period is 67ms for 100BT or 500ms for 10BT. The
default is 1%.
000
Register 7 (0x07): Global Control 5
Bit
Name
R/W
Description
Default
7-0
Broadcast
Storm
Protection
Rate
(1)
Bit [7:0]
R/W
This register along with the previous register determines how many
“64 byte blocks” of packet data are allowed on an input port in a
preset period. The period is 67ms for 100BT or 500ms for 10BT.
The default is 1%.
0x63
Note:
(1) 100BT Rate: 148,800 frames/sec * 67 ms/interval * 1% = 99 frames/interval (approx.) = 0x63
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