參數(shù)資料
型號： PIC12F683T-I/MD
廠商： Microchip Technology
文件頁數(shù)： 24/176頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 2KX14 8DFN
產(chǎn)品培訓模塊： Asynchronous Stimulus
Digi-Key 應用說明： AN0005 PWM Example with Microchip's CCP Module
AN0005 Example Code
標準包裝： 3,300
系列： PIC® 12F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
外圍設備： 欠壓檢測/復位，POR，PWM，WDT
輸入/輸出數(shù)： 5
程序存儲器容量： 3.5KB（2K x 14）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 4x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 8-VDFN 裸露焊盤
包裝： 帶卷 (TR)
配用： AC164326-ND - MODULA SKT PM3 20QFN
I3-DB12F683-ND - BOARD DAUGHTER ICEPIC3
PIC12F683
DS41211D-page 10
2007 Microchip Technology Inc.
TABLE 3-2:
PIC12F683 SPECIAL FUNCTION REGISTERS SUMMARY BANK 1
Addr
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR, BOR
Page
Bank 1
80h
INDF
Addressing this location uses contents of FSR to address data memory (not a physical register) xxxx xxxx 17, 90
81h
OPTION_REG
GPPU
INTEDG
T0CS
T0SE
PSA
PS2
PS1
PS0
1111 1111
82h
PCL
Program Counter’s (PC) Least Significant Byte
0000 0000
83h
STATUS
IRP(1)
RP1(1)
RP0
TO
PD
ZDC
C
0001 1xxx
84h
FSR
Indirect Data Memory Address Pointer
xxxx xxxx
85h
TRISIO
—
TRISIO5
TRISIO4
TRISIO3
TRISIO2
TRISIO1
TRISIO0 --11 1111 32, 90
86h
—
Unimplemented
—
87h
—
Unimplemented
—
88h
—
Unimplemented
—
89h
—
Unimplemented
—
8Ah
PCLATH
—
Write Buffer for upper 5 bits of Program Counter
---0 0000
8Bh
INTCON
GIE
PEIE
T0IE
INTE
GPIE
T0IF
INTF
GPIF
0000 0000
8Ch
PIE1
EEIE
ADIE
CCP1IE
—
CMIE
OSFIE
TMR2IE
TMR1IE
000- 0000
8Dh
—
Unimplemented
—
8Eh
PCON
—
ULPWUE SBOREN
—
—POR
BOR
--01 --qq
8Fh
OSCCON
—
IRCF2
IRCF1
IRCF0
OSTS(2)
HTS
LTS
SCS
-110 x000
90h
OSCTUNE
—
TUN4
TUN3
TUN2
TUN1
TUN0
---0 0000
91h
—
Unimplemented
—
92h
PR2
Timer2 Module Period Register
1111 1111
93h
—
Unimplemented
—
94h
—
Unimplemented
—
95h
WPU(3)
—
—WPU5
WPU4
—
WPU2
WPU1
WPU0
--11 -111
96h
IOC
—
IOC5
IOC4
IOC3
IOC2
IOC1
IOC0
--00 0000
97h
—
Unimplemented
—
98h
—
Unimplemented
—
99h
VRCON
VREN
—VRR
—
VR3
VR2
VR1
VR0
0-0- 0000
9Ah
EEDAT
EEDAT7
EEDAT6
EEDAT5
EEDAT4
EEDAT3
EEDAT2
EEDAT1
EEDAT0 0000 0000 71, 90
9Bh
EEADR
EEADR7
EEADR6
EEADR5
EEADR4
EEADR3
EEADR2
EEADR1
EEADR0 0000 0000 71, 90
9Ch
EECON1
—
WRERR
WREN
WR
RD
---- x000
9Dh
EECON2
EEPROM Control Register 2 (not a physical register)
---- ----
9Eh
ADRESL
Least Significant 2 bits of the left shifted result or 8 bits of the right shifted result
xxxx xxxx
9Fh
ANSEL
—
ADCS2
ADCS1
ADCS0
ANS3
ANS2
ANS1
ANS0
-000 1111
Legend:
– = unimplemented locations read as ‘0’, u = unchanged, x = unknown, q = value depends on condition,
shaded = unimplemented
Note
1:
IRP and RP1 bits are reserved, always maintain these bits clear.
2:
OSTS bit of the OSCCON register reset to ‘0’ with Dual Speed Start-up and LP, HS or XT selected as the oscillator.
3:
GP3 pull-up is enabled when MCLRE is ‘1’ in the Configuration Word register.
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PDF描述
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V300A28C400BL2 CONVERTER MOD DC/DC 28V 400W
V300A28C400BF3 CONVERTER MOD DC/DC 28V 400W
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參數(shù)描述
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