參數(shù)資料
型號(hào): PEF82902H
元件分類(lèi): 視頻放大器
英文描述: Low Cost Dual and Quad Video Amplifiers; Package: SO; No of Pins: 8; Temperature Range: 0°C to +70°C
中文描述: ?4B3T二將軍ModuIar整體服務(wù)數(shù)位網(wǎng)路新臺(tái)幣(智能)?
文件頁(yè)數(shù): 66/205頁(yè)
文件大?。?/td> 3205K
代理商: PEF82902H
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PEF 82902
Functional Description
Data Sheet
54
2001-11-09
Figure 29
Structure of Last Octet of Ch2 on DD
2.3.5.4
D-Channel Arbitration
In intelligent NT applications (selected via register S_MODE.MODE2-0) the T-SMINT I
has to share the upstream D-channel with one or more D-channel controllers on the
IOM -2 interface and with all connected TEs on the S interface.
The S-transceiver incorporates an elaborate state machine for D-channel priority
handling on IOM -2 (
Chapter 2.3.5.5
). For the access to the D-channel a similar
arbitration mechanism as on the S interface (writing D-bits, reading back E-bits) is
performed for all D-channel sources on IOM -2. Due to this an equal and fair access is
guaranteed for all D-channel sources on both the S interface and the IOM -2 interface.
The access to the upstream D-channel is handled via the S/G bit for the HDLC
controllers and via E-bit for all connected terminals on S (E-bits are inverted to block the
terminals on S). Furthermore, if more than one HDLC source is requesting D-channel
access on IOM -2 the TIC bus mechanism is used (see
Chapter 2.3.5.2
).
The arbiter permanently counts the
1s
in the upstream D-channel on IOM -2. If the
necessary number of
1s
is counted and an HDLC controller on IOM -2 requests
upstream D-channel access (BAC bit is set to 0), the arbiter allows this D-channel
controller immediate access and blocks other TEs on S (E-bits are inverted). Similar as
on the S-interface the priority for D-channel access on IOM -2 can be configured to 8 or
10 (S_CMD.DPRIO).
The configuration settings of the T-SMINT I in intelligent NT applications are
summarized in
Table 12
.
B1
B2
MON
0
D CI0
IC1
IC2
MON1
CI1
MX
MR
MX
MR
S/G
A/B
S/G A/B
Stop/Go
Available/Blocked
ITD09693.vsd
DD
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PDF描述
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