參數(shù)資料
型號(hào)： PEF2256H
廠商： INFINEON TECHNOLOGIES AG
元件分類： 通信及網(wǎng)絡(luò)
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁數(shù)： 206/518頁
文件大?。?/td> 6420K
代理商： PEF2256H
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FALC
56
PEF 2256 H/E
Operational Description T1/J1
User’s Manual
Hardware Description
206
DS1.1, 2003-10-23
consequent actions to remote end and internal system depend on the activation
procedure selected.
Note: Read access to unused register addresses: value should be ignored.
Write access to unused register addresses: should be avoided, or set to 00
H
in
address range up to AF
H
; must be avoided in address range above AF
H
if not
defined elsewhere.
All control registers (except XFIFO, XS(12:1), CMDR, DEC) are of type read/write
Table 55
Basic Set Up
Master clocking mode
T1/J1 mode select
Initialization Parameters (T1/J1)
T1
GCM(8:1) according to external MCLK clock frequency
FMR1.PMOD = 1,
RC0.SJR = 0
Specification of line
interface and clock
generation
Line interface coding
FMR0.XC(1:0), FMR0.RC(1:0)
Loss-of-signal detection/
recovery conditions
System clocking and data
rate
IRSC/IXSP/IXSC
Channel translation mode
FMR1.CTM
Transmit offset counters
XC0.XCO, XC1.XTO
Receive offset counters
RC0.RCO, RC1.RTO
AIS to system interface
FMR2.DAIS/SAIS
Operational Setup
Select framing
FMR4.FM(1:0)
Framing additions
FMR1.CRC, FMR0.SRAF
Synchronization mode
FMR4.AUTO, FMR4.SSC(1:0), FMR2.MCSP,
FMR2.SSP
Signaling mode
FMR5.EIBR, XC0.BRM, MODE, MODE2, MODE3,
CCR1, CCR2, RAH(2:1), RAL(2:1)
J1
FMR1.PMOD = 1,
RC0.SJR = 1
LIM0, LIM1, XPM(2:0)
PCD, PCR, LIM1, LIM2
SIC1.SSC(1:0), SIC1.SSD1, FMR1.SSD0, CMR1.IRSP/
相關(guān)PDF資料
PDF描述
PEF22810 ETHERNET OVER VDSL CHIPSET
PEF22822FV22 ETHERNET OVER VDSL CHIPSET
PEF22822ELV22 ETHERNET OVER VDSL CHIPSET
PEB22811HV13 ETHERNET OVER VDSL CHIPSET
PEF22810TV21 ETHERNET OVER VDSL CHIPSET
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PEF2256HV22XP 制造商:Lantiq 功能描述:Framer E1/J1/T1 1.8V/3.3V 80-Pin MQFP
PEF2260NV3.0 制造商:Infineon Technologies AG 功能描述:
PEF2260NV3.0SICOFI 制造商:Rochester Electronics LLC 功能描述:- Bulk
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