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參數(shù)資料
| 型號(hào)： | PEF20542 |
| 廠(chǎng)商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | 2 Channel Serial Optimized Communication Controller with DMA |
| 中文描述： | 2通道串行通信控制器的優(yōu)化與DMA |
| 文件頁(yè)數(shù)： | 259/300頁(yè) |
| 文件大?。?/td> | 3878K |
| 代理商： | PEF20542 |
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PEB 20542
PEF 20542
Programming
Data Sheet
259
2000-09-14
HDLC/SDLC/PPP
The transmission of a packet can be started by issuing an
’
XF
’
or
’
XIF
’
command via the
CMDRL
register. If enabled, a specified number of preambles (refer to registers
CCR2H
and
PREAMB
) are sent out optionally before transmission of the current packet starts.
If the transmit command does not include an end of message indication (
CMDRL
.XME),
SEROCCO-D will repeatedly request for the next data block by means of an
’
XPR
’
interrupt as soon as no more than 32 bytes are stored in the XFIFO, i.e. a 32-byte pool
is accessible to the CPU.
This process will be repeated until the CPU indicates the end of message per
’
XME
’
command, after which packet transmission is finished correctly by appending the CRC
and closing flag sequence. Consecutive packets may be transmitted as back-to-back
packets and may even share a flag (enabled via
CCR1L
.SFLG), if service of XFIFO is
quick enough.
In case no more data is available in the XFIFO prior to the arrival of the end-of-message
indiction (
’
XME
’
), the transmission of the packet is terminated with an abort sequence
and the CPU is notified per interrupt (
ISR1
.XDU, transmit data underrun). The packet
may also be aborted per software at any time (
CMDRL
.XRES).
The data transmission sequence, from the CPU
’
s point of view, is outlined in
Figure 59
.
ASYNC
The transmission of character(s) can be started by issuing a
’
XF
’
command via the
CMDRL
register. SEROCCO-D will repeatedly request for the next data block by means
of an
’
XPR
’
interrupt as soon as no more than 32 bytes are stored in the XFIFO, i.e. a
32-byte pool is accessible to the CPU. Transmission may be aborted per software
(
CMDRL
.XRES).
BISYNC
The transmission of a block can be started by issuing an
’
XF
’
command via the
CMDRL
register. Further handling of data transmission with respect to preamble transmission
and command
’
XME
’
is similar to HDLC/SDLC mode. After
’
XME
’
command has been
issued, the block is finished by appending the internally generated CRC if enabled (refer
to description of register
CCR2H
).
In case no more data is available in the XFIFO prior to the arrival of
’
XME
’
, the
transmission of the block is terminated with IDLE and the CPU is notified per interrupt
(
ISR1
.XDU). The block may also be aborted per software (
CMDRL
.XRES). The data
transmission flow, from the CPU
’
s point of view, is outlined in
Figure 59
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEB20542 | 2 Channel Serial Optimized Communication Controller with DMA |
| PEF20550 | ICs for Communications |
| PEB20550 | ICs for Communications |
| PEF20570 | DSP Embedded Line and Port Interface Controller |
| PEF20571 | DSP Embedded Line and Port Interface Controller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PEF20542FV1.3 | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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| PEF2054NV1.0EPICS | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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