參數(shù)資料
型號(hào): PEF20321
廠(chǎng)商: INFINEON TECHNOLOGIES AG
英文描述: Multichannel Network Interface Controller for HDLC
中文描述: 多通道網(wǎng)絡(luò)接口控制器的HDLC
文件頁(yè)數(shù): 139/366頁(yè)
文件大?。?/td> 4832K
代理商: PEF20321
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PEB 20321
PEF 20321
Microprocessor Bus Interface
Data Sheet
139
2001-02-14
21
0
B
66 MHz Capable
The MUNICH32X is not 66 MHz capable
Reserved
Reserved
Fast Back-to-Back enable
A value of
1
means the MUNICH32X is allowed to generate
fast Back-to-Back transactions to different agents.
A value of
0
means the MUNICH32X is only allowed to
generate fast Back-to-Back transaction to the same agent.
SERR Enable
A value of
1
enables the SERR driver.
A value of
0
disables the SERR driver.
Wait Cycle Control
The MUNICH32X does never perform address/data stepping.
Parity Error Response
When this bit is set the MUNICH32X will take its normal action
when a parity error is detected. When this bit is
0
the
MUNICH32X ignores any parity errors that it detects and
continues normal operation.
VGA Palette Snoop
The MUNICH32X is no VGA-Device.
Memory Write and Invalidate Enable
The
Invalidate
command is not supported by the
MUNICH32X.
Special Cycles
All special cycles are ignored.
Note: Although this bit can be set it has no effect.
Bus Master
A value of
1
enables the bus master capability.
Note: Before giving the first action request it is necessary to
set this bit.
Memory Space
A value of
1
allows the MUNICH32X to respond to Memory
Space Addresses.
Note: This bit must be set before the first read/write
transactions to the MUNICH32X will be started.
20
16
15
10
9
00000
B
000000
B
FBBE
8
SERRE
7
0
B
6
PER
5
0
B
4
0
B
3
SC
2
BM
1
MS
Status and Command register bits
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PDF描述
PEB20321 Multichannel Network Interface Controller for HDLC
PEB20321 Multichannel Network Interface Controller for HDLC MUNICH32X
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