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參數(shù)資料
| 型號： | PEB3445E |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 通信及網(wǎng)絡 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 22/211頁 |
| 文件大?。?/td> | 2567K |
| 代理商： | PEB3445E |
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PEB 3445 E
Pin Description
Data Sheet
22
2001-06-29
G19
LBHE
or
LBLE
I
I
Byte High Enable (Intel Bus Mode)
If 16-bit bus interface mode is enabled,
this signal indicates a data transfer on the
upper byte LD(15:8) of the data bus.
In 8-bit bus interface mode this signal has
no function and should be tied to
V
DD3
.
Refer to
Chapter 5.1
for detailed
information.
Byte Access (Motorola Bus Mode)
If 16-bit bus interface mode is enabled,
this signal indicates a data transfer on the
lower byte LD(7:0) of the data bus. In
8-bit bus interface mode this signal has no
function and should be tied to
V
DD3
. Refer
to
Chapter 5.1
for detailed information.
Data Request Receive
This signal indicates that the receive
FIFO of the path maintenance data link
channel contains a byte which has to be
read by an external CPU.
Receive Message Complete
This signal indicates that the DMA
controller has to read the port status
register PPSR in order to release the
receive FIFO.
Data Request Transmit
This signal indicates a request to store a
new byte in the transmit FIFO of the path
maintenance data link channel.
Transmit Message End
This signal in combination with DRT
indicates that the byte written to the
transmit FIFO is the last byte of a HDLC
message. TXME has to asserted together
with the data signal LD.
J18
DRR
O
K19
RMC
O
J19
DRT
O
K18
TXME
I
Pin No.
Symbol
Input (I)
Output (O)
Function
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| PEB3456E | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:Channelized T3 Termination with DS3 Framer, M13 Multiplexer, T1/ E1 Framers and 256 Channel HDLC/PPP controller |
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