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參數(shù)資料
| 型號： | PDI1394L11 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | 1394 AV Link Layer Controller(AV（音頻/視頻）鏈接層控制器) |
| 中文描述： | 1394影音鏈路層控制器（視聽（音頻/視頻）鏈接層控制器） |
| 文件頁數(shù)： | 41/46頁 |
| 文件大?。?/td> | 294K |
| 代理商： | PDI1394L11 |
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Philips Semiconductors
Product specification
PDI1394L11
1394 AV link layer controller
1997 Oct 21
41
14.1
Pin Categories
Table 11. Pin Categories
Category 1:
Input/Output
Category 2:
Input
Category 3:
Input
Category 4:
Output
Category 5:
Output
Category 6:
Input/Output
Category 7:
Category 8:
HIF D[7:0]
HIF A[8:0]
RESET_N
CYCLEOUT
HIF INT_N
PHY D[0:7]
LREQ
SCLK
AVSYNC
HIF CS_N
CYCLEIN
AVERR0
PHY CTL[0:1]
AVVALID
HIF WR_N
AVCLK
AVERR1
AV D[7:0]
HIF RD_N
ISO_N
CLK25
AVFSYNCIN
AVFSYNCOUT
AVENDPCK
15.0
GND = 0V, C
L
= 50pF
AC CHARACTERISTICS
LIMITS
SYMBOL
PARAMETER
TEST CONDITIONS
WAVEFORMS
T
amb
= 0
°
C to +70
°
C
MIN
UNIT
TYP
MAX
t
PERIOD
t
SU
t
IH
t
OD
t
WHIGH
t
WLOW
t
PWFSO
t
PWFSI
t
SUP
t
HP
t
SCLKPER
t
DP
t
AS
t
AH
t
CL
t
CH
t
RP
t
ACC
t
DH
t
DS
t
WRP
t
CWH
t
CWL
t
CP
t
CD
t
RESET
AV clock period
Figure 23
41.67
ns
AV clock setup time
Figure 23
20
ns
AV clock input hold time
Figure 23
3
ns
AV clock output delay time
Figure 23
3
20
ns
AV clock pulse width HIGH
Figure 23
AV clock pulse width LOW
Figure 23
AVFSYNCOUT pulse width HIGH
Figure 24
100
140
ns
AVFSYNCIN pulse width HIGH
Figure 25
100
ns
PHY-link setup time
Figure 26
6.0
ns
PHY-link hold time
Figure 26
2.5
ns
SCLK period
Figure 26
20.347
20.345
20.343
ns
PHY-link output delay
Note: C
L
= 20pF
Figure 27
2.0
14.0
ns
Host address setup time
Figure 28
0
ns
Host address hold time
Figure 28
0
ns
Host chip select pulse width LOW
Figure 28
115
ns
Host chip select pulse width HIGH
Figure 28
42
ns
Host read pulse width
Figure 28
115
ns
Host access time
Figure 28
115
ns
Host data hold time
Figure 28
0
ns
Host data setup time
Figure 28
0
ns
Host write pulse width
Figure 28
115
ns
CYCLEIN HIGH pulse width
Figure 29
200
ns
CYCLEIN LOW pulse width
Figure 29
200
ns
CYCLEIN cycle period
Figure 29
125
μ
s
CYCLEOUT cycle delay
Figure 30
20
ns
RESET_N pulse width LOW
Figure 31
10
μ
s
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PDI1394L21 | Full Duplex AV Link Layer Ccontroller(全雙工AV鏈接層控制器) |
| PDI1394L41 | Content Protection AV Link Layer(內(nèi)容可保護(hù)的AV鏈接層控制器) |
| PDI1394P21 | 3-port Physical Layer Interface(三端口物理層接口) |
| PDI1394P22 | 3-port Physical Layer Interface(三端口物理層接口) |
| PDI1394P24 | 2-port 400 Mbps physical layer interface(2端口 400 Mbps物理層接口) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PDI1394L11BA | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:1394 AV link layer controller |
| PDI1394L11BA-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:IEEE 1394 (Firewire) Bus Interface/Controller |
| PDI1394L21 | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:1394 full duplex AV link layer controller |
| PDI1394L21BE | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:1394 full duplex AV link layer controller |
| PDI1394L21BP | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:1394 full duplex AV link layer controller |
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