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參數(shù)資料
| 型號： | P87C552 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | 80C51 8-bit microcontroller(80C51八位微控制器) |
| 中文描述： | 80C51的8位微控制器（80C51的八位微控制器） |
| 文件頁數(shù)： | 66/74頁 |
| 文件大?。?/td> | 368K |
| 代理商： | P87C552 |
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Philips Semiconductors
Preliminary specification
P87C552
80C51 8-bit microcontroller
8K/256 OTP, 8 channel 10 bit A/D, I
2
C, PWM,
capture/compare, high I/O, low voltage (2.7V–5.5V), low power
1999 Mar 30
66
AC ELECTRICAL CHARACTERISTICS
(Continued)
SYMBOL
PARAMETER
INPUT
OUTPUT
I
2
C Interface (Refer to Figure 55)
5
t
HD;STA
START condition hold time
t
LOW
SCL low time
t
HIGH
SCL high time
t
RC
SCL rise time
FC
SCL fall time
t
SU;DAT1
Data set-up time
t
SU;DAT2
SDA set-up time (before rep. START cond.)
t
SU;DAT3
SDA set-up time (before STOP cond.)
t
HD;DAT
Data hold time
t
SU;STA
Repeated START set-up time
t
SU;STO
STOP condition set-up time
t
BUF
Bus free time
t
RD
SDA rise time
t
FD
SDA fall time
NOTES:
1. At 100 kbit/s. At other bit rates this value is inversely proportional to the bit-rate of 100 kbit/s.
2. Determined by the external bus-line capacitance and the external bus-line pull-resistor, this must be < 1
μ
s.
3. Spikes on the SDA and SCL lines with a duration of less than 3 t
CLCL
will be filtered out. Maximum capacitance on bus-lines SDA and
SCL = 400pF.
4. t
CLCL
= 1/f
2
= one oscillator clock period at pin XTAL1. For 62ns (42s) < t
CLCL
< 285ns (16MHz > f
OSC
> 3.5MHz) the SI01 interface
meets the I
C-bus specification for bit-rates up to 100 kbit/s.
5. These values are guaranteed but not 100% production tested.
≥
14 t
CLCL
≥
16 t
CLCL
≥
14 t
CLCL
≤
1
μ
s
≤
0.3
μ
s
≥
250ns
≥
250ns
≥
250ns
≥
0ns
≥
14 t
CLCL
≥
14 t
CLCL
≥
14 t
CLCL
≤
1
μ
s
≤
0.3
μ
s
> 4.0
μ
s
1
> 4.7
μ
s
1
> 4.0
μ
s
1
–
2
< 0.3
μ
s
3
> 20 t
CLCL
– t
RD
> 1
μ
s
1
> 8 t
CLCL
> 8 t
CLCL
– t
FC
> 4.7
μ
s
1
> 4.0
μ
s
1
> 4.7
μ
s
1
–
2
< 0.3
μ
s
3
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PDF描述 |
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