參數(shù)資料
型號(hào)： NB7N017MMNR2G
廠商： ON Semiconductor
文件頁數(shù)： 8/19頁
文件大?。?/td> 0K
描述： IC DIVIDER 8BIT DUAL CML 52-QFN
標(biāo)準(zhǔn)包裝： 2,000
類型： 時(shí)鐘除法器
PLL： 無
輸入： CML，ECL，LVCMOS，LVDS，LVTTL
輸出： CML
電路數(shù)： 1
比率 - 輸入:輸出： 1:1
差分 - 輸入:輸出： 是/是
頻率 - 最大： 3.5GHz
除法器/乘法器： 是/無
電源電壓： ±3 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 52-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 52-QFN（8x8）
包裝： 帶卷 (TR)
NB7N017M
http://onsemi.com
16
Figure 15. Timing Diagram for SEL Input
(Before Critical Rising Edge of CLK)
MR
CLK
SEL
Pa[7:0]
Pb[7:0]
PLa
PLb
TC[7:0]
03
02
delay
d=4
d=3
Figure 16. Timing Diagram for SEL Input
(After Critical Rising Edge of CLK)
MR
CLK
SEL
Pa[7:0]
Pb[7:0]
PLa
PLb
TC[7:0]
03
02
delay
d=4
d=3
Figure 17. Timing Diagram Relating PLa, PLb, Pa(0:7), Pb(0:7)
MR
CLK
Pa[7:0]
PLa
Pa_INT[7:0]
Pb[7:0]
PLb
Pb_INT[7:0]
SEL
MUX_INT[7:0]
01
02
03
04
05
06
07
08
255
2
5
6
7
103
201
255
10
151
27
43
176
255
201
151
27
43
255
2
5 151
27
43
Pb/PLb have the same functionality as Pa/PLa
MUX_OUT is the output of the internal MUX
d=3
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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