Figure 2. Pinout SOIC8 / DFN8 (Top View) CLKA 1 2 3 4 8 7 6 5 ENABLEn S0 " />
參數(shù)資料
型號(hào): NB3N3010BDR2G
廠商: ON Semiconductor
文件頁(yè)數(shù): 2/9頁(yè)
文件大?。?/td> 0K
描述: IC CLOCK GENERATOR PLL 8SOIC
標(biāo)準(zhǔn)包裝: 2,500
類型: 時(shí)鐘/頻率發(fā)生器
PLL: 無(wú)
主要目的: USB 應(yīng)用
輸入: 時(shí)鐘
輸出: LVCMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:2
差分 - 輸入:輸出: 無(wú)/無(wú)
頻率 - 最大: 12.288MHz
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 8-SOIC(0.154",3.90mm 寬)
供應(yīng)商設(shè)備封裝: 8-SOICN
包裝: 帶卷 (TR)
NB3N3010B
http://onsemi.com
2
Figure 2. Pinout SOIC8 / DFN8 (Top View)
CLKA
1
2
3
4
8
7
6
5
ENABLEn
S0
REF
GND
VDD
CLKB
CFILT
NB3N3010B
Table 1. PIN DESCRIPTION
Pin
Symbol
I/O
Description
1
ENABLEn
LVTTL/
LVCMOS Input
Low active Output Enable; Defaults HIGH when left open; Internal pullup resistor to
VDD.
2
S0
LVTTL/
LVCMOS Input
Frequency Select Input. See input frequency select Table 2 for details. Defaults HIGH
when left open. Internal pullup resistor to VDD.
3
REF
Input
Reference Clock input
4
GND
Power Supply
Negative Supply Voltage; Ground 0 V. This pin provides GND return path to the VDD
supply.
5
CFILT
Analog
Connection for external filter capacitor for internal +1.8 V regulator; see Figure 4.
6
CLKA
LVCMOS
Output
Clock output, copy A (12.288 MHz)
7
CLKB
LVCMOS
Output
Clock output, copy B (12.288 MHz)
8
VDD
Power Supply
Positive Supply Voltage, +3.3 V $5%
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