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參數(shù)資料
| 型號： | MT8952B |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | HDLC Protocol Controller(高階數(shù)據(jù)鏈路控制（HDLC）的協(xié)議控制器) |
| 中文描述： | HDLC協(xié)議控制器（高階數(shù)據(jù)鏈路控制（HDLC的）的協(xié)議控制器） |
| 文件頁數(shù)： | 19/27頁 |
| 文件大?。?/td> | 170K |
| 代理商： | MT8952B |
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ISO-CMOS
MT8952B
3-79
Figure 18 - Timing Information for MPU Read
Figure 19 - Interrupt Request Release Time
Figure 20 - Watchdog Timer Input and Output
CS
E
CS
E
R/W
A0-A3
D0-D7
E clock initiates and
terminates the read cycle
CS initiates and
terminates the read cycle
VALID DATA
High Impedance
High Impedance
t
CSE
t
EWH
t
r
t
f
t
CYC
t
CSE
t
RWS
t
RWH
t
AS
t
AH
t
DZL
t
DZH
t
DLZ
t
DHZ
t
EWL
NOTE:
The read cycle cn be initiated either by the falling edge ofCS or the rising edge of E clock whichever occurs last. Similarly
the cycle can be terminated by CS (rising edge) or E clock (falling edge) whichever occurs first. The timing relations are to be
referenced from the active edge initiating or terminating the cycle.
E
IRQ
t
IRQR
F0i
WD
t
WDHL
t
WDLH
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PDF描述 |
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