參數(shù)資料
型號(hào)： MSM82C55A-2GS-2K
廠(chǎng)商： LAPIS SEMICONDUCTOR CO LTD
元件分類(lèi)： 微控制器/微處理器
英文描述： 24 I/O, PIA-GENERAL PURPOSE, PQFP44
封裝： 0.80 MM PITCH, PLASTIC, QFP-44
文件頁(yè)數(shù)： 17/27頁(yè)
文件大?。?/td> 207K
代理商： MSM82C55A-2GS-2K
23/26
Semiconductor
MSM82C55A-2RS/GS/VJS
As shown above, the MSM82C55A-2 satisfies the characteristics of the MSM82C55A-5.
Parameter
Symbol
MSM82C55A-5
MSM82C55A-2
Address Hold Time for WR Rising
30 ns minimum
20 ns minimum
tWA
WR Pulse Width
300 ns minimum
150 ns minimum
tWW
Data Setup Time for WR Rising
1000 ns minimum
50 ns minimum
tDW
Data Hold Time for WR Rising
40 ns minimum
30 ns minimum
tWD
Defined Data Output Time
From WR Rising
350 ns maximum
200 ns maximum
tWB
Port Data Hold Time for RD Rising
20 ns minimum
10 ns minimum
tHR
ACK Pulse Width
300 ns minimum
100 ns minimum
tAK
STB Pulse Width
300 ns minimum
100 ns minimum
tST
Port Data Hold Time for STB Falling
180 ns minimum
50 ns minimum
tPH
ACK Falling to Defined Data Output
300 ns maximum
150 ns maximum
tAD
WR Falling to OBF Falling Delay Time
650 ns maximum
150 ns maximum
tWOB
ACK Falling to OBF Rising Delay Time
350 ns maximum
150 ns maximum
tAOB
STB Falling to IBF Rising Delay Time
300 ns maximum
150 ns maximum
tSIB
RD Rising to IBF Falling Delay Time
300 ns maximum
150 ns maximum
tRIB
RD Falling to INTR Falling Delay Time
400 ns maximum
200 ns maximum
tRIT
STB Rising to INTR Rising Delay Time
300 ns maximum
150 ns maximum
tSIT
ACK Rising to INTR Rising Delay Time
350 ns maximum
150 ns maximum
tAIT
WR Falling to INTR Falling Delay Time
850 ns minimum
250 ns maximum
tWIT
相關(guān)PDF資料
PDF描述
MSM82C55A-2RS 24 I/O, PIA-GENERAL PURPOSE, PDIP40
MSM82C55A-2VJS 24 I/O, PIA-GENERAL PURPOSE, PQCC44
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MSM82C84A-2JS OTHER CLOCK GENERATOR, PQCC20
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