參數(shù)資料
型號(hào)： MSM63188A-XXXGS-BK
廠商： LAPIS SEMICONDUCTOR CO LTD
元件分類： 微控制器/微處理器
英文描述： 4-BIT, MROM, 2 MHz, MICROCONTROLLER, PQFP176
封裝： 24 X 24 MM, 0.50 MM PITCH, PLASTIC, LQFP-176
文件頁數(shù)： 188/344頁
文件大?。?/td> 1980K
代理商： MSM63188A-XXXGS-BK
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MSM63182A/184A/188A User’s Manual
Chapter 19
Multiplication/Division Circuit (MULDIV)
19 – 4
M188A
19.2.2
Multiplication/division condition register (MDCR)
MDCR is a 4-bit special function register (SFR) with a multiplication/division start flag and a status flag
indicating the status of the operation when finished.
OV
EF
DIVS
MULS
MDCR (086H)
(R/W)
b3
b2
b1
b0
Overflow flag
0 : (initial value)
1 : When result of 8-bit
× 8-bit multiplication is more than 8 bits (D register ≠ 0)
Error flag
0 : (initial value)
1 : Division by zero (E register = 00H)
Division start flag
0 : Stop (initial value)
1 : Start
Multiplication start flag
0 : Stop (initial value)
1 : Start
Bit 3: OV (overflow flag)
Set to “1” when there is a carry (D register other than 00H) to the high-order 8 bits in multiplication, and
otherwise cleared to “0”.
This bit is initialized to “0” at system reset.
Bit 2: EF (error flag)
Set to “1” when the E register is “0” in division, and otherwise cleared to “0”.
This bit is initialized to “0” at
system reset.
Bit 1: DIVS (DIV start)
Division is started when this bit is set to “1”, and is completed in ten machine cycles.
When division is
complete DIVS is reset to “0”.
This bit initializes to “0” at system reset.
Bit 0: MULS (MUL start)
This flag starts multiplication when set to “1”, and multiplication is completed in five machine cycles.
MULS is cleared to “0” when multiplication is complete.
This bit is reset to “0” at system reset.
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