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參數(shù)資料
| 型號(hào)： | MQ80C32-30SBR |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 30 MHz, MICROCONTROLLER, CQFP44 |
| 文件頁(yè)數(shù)： | 43/324頁(yè) |
| 文件大?。?/td> | 3748K |
| 代理商： | MQ80C32-30SBR |
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137
2513L–AVR–03/2013
ATmega162/V
Extended
Timer/Counter
Interrupt Flag Register
– ETIFR
Note:
1. This register contains flag bits for several Timer/Counters, but only Timer3 bits are described
in this section. The remaining bits are described in their respective Timer sections.
Bit 5 – ICF3: Timer/Counter3, Input Capture Flag
This flag is set when a capture event occurs on the ICP3 pin. When the Input Capture Register
(ICR3) is set by the WGMn3:0 to be used as the TOP value, the ICF3 Flag is set when the coun-
ter reaches the TOP value.
ICF3 is automatically cleared when the Input Capture Interrupt Vector is executed. Alternatively,
ICF3 can be cleared by writing a logic one to its bit location.
Bit 4 – OCF3A: Timer/Counter3, Output Compare A Match Flag
This flag is set in the timer clock cycle after the counter (TCNT3) value matches the Output
Compare Register A (OCR3A).
Note that a Forced Output Compare (FOC3A) strobe will not set the OCF3A Flag.
OCF3A is automatically cleared when the Output Compare Match A Interrupt Vector is exe-
cuted. Alternatively, OCF3A can be cleared by writing a logic one to its bit location.
Bit 3 – OCF3B: Timer/Counter3, Output Compare B Match Flag
This flag is set in the timer clock cycle after the counter (TCNT3) value matches the Output
Compare Register B (OCR3B).
Note that a Forced Output Compare (FOC3B) strobe will not set the OCF3B Flag.
OCF3B is automatically cleared when the Output Compare Match B Interrupt Vector is exe-
cuted. Alternatively, OCF3B can be cleared by writing a logic one to its bit location.
Bit 2 – TOV3: Timer/Counter3, Overflow Flag
The setting of this flag is dependent of the WGMn3:0 bits setting. In normal and CTC modes, the
TOV3 Flag is set when the timer overflows. Refer to Table 56 on page 130 for the TOV3 Flag
behavior when using another WGMn3:0 bit setting.
TOV3 is automatically cleared when the Timer/Counter3 Overflow Interrupt Vector is executed.
Alternatively, TOV3 can be cleared by writing a logic one to its bit location.
Bit
765
4321
0
ICF3
OCF3A
OC3FB
TOV3
–
–ETIFR
Read/Write
R
R/W
R
Initial Value
000
0000
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MR80C32E-30 | 8-BIT, 30 MHz, MICROCONTROLLER, CQCC44 |
| R80C32E-44 | 8-BIT, 44 MHz, MICROCONTROLLER, CQCC44 |
| MC8259A | 8086; 8088; 80186 COMPATIBLE, INTERRUPT CONTROLLER, CDIP28 |
| MC8610PX800GZ | MICROPROCESSOR, PBGA783 |
| MC8610VT800GZ | MICROPROCESSOR, PBGA783 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MQ82370-20 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| MQ8238020 | 制造商:Intel 功能描述:CONTROLLER: OTHER |
| MQ82380-20 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| MQ82380-20/R | 制造商:Rochester Electronics LLC 功能描述: |
| MQ82592 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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