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參數(shù)資料
| 型號： | MQ80C154-16P883D |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 16 MHz, MICROCONTROLLER, CQFP44 |
| 文件頁數(shù)： | 203/849頁 |
| 文件大?。?/td> | 12530K |
| 代理商： | MQ80C154-16P883D |
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281
32099I–01/2012
AT32UC3L016/32/64
15.4.1
Power Management
When the WDT is enabled, the WDT remains clocked in all sleep modes. It is not possible to
enter sleep modes where the source clock of CLK_CNT is stopped. Attempting to do so will
result in the device entering the lowest sleep mode where the source clock is running, leaving
the WDT operational. Please refer to the Power Manager chapter for details about sleep modes.
After a watchdog reset the WDT bit in the Reset Cause Register (RCAUSE) in the Power Man-
ager will be set.
15.4.2
Clocks
The clock for the WDT bus interface (CLK_WDT) is generated by the Power Manager. This
clock is enabled at reset, and can be disabled in the Power Manager. It is recommended to dis-
able the WDT before disabling the clock, to avoid freezing the WDT in an undefined state.
There are two possible clock sources for the Watchdog Timer (CLK_CNT):
System RC oscillator (RCSYS): This oscillator is always enabled when selected as clock
source for the WDT. Please refer to the Power Manager chapter for details about the RCSYS
and sleep modes. Please refer to the Electrical Characteristics chapter for the characteristic
frequency of this oscillator.
32 KHz crystal oscillator (OSC32K): This oscillator has to be enabled in the System Control
Interface before using it as clock source for the WDT. The WDT will not be able to detect if
this clock is stopped.
15.4.3
Debug Operation
The WDT counter is frozen during debug operation, unless the Run In Debug bit in the Develop-
ment Control Register is set and the bit corresponding to the WDT is set in the Peripheral Debug
Register (PDBG). Please refer to the On-Chip Debug chapter in the AVR32UC Technical Refer-
ence Manual, and the OCD Module Configuration section, for details. If the WDT counter is not
frozen during debug operation it will need periodically clearing to avoid a watchdog reset.
15.4.4
Fuses
The WDT can be enabled at reset. This is controlled by the WDTAUTO fuse, see Section 15.5.4
for details. Please refer to the Fuse Settings section in the Flash Controller chapter for details
about WDTAUTO and how to program the fuses.
15.5
Functional Description
15.5.1
Basic Mode
15.5.1.1
WDT Control Register Access
To avoid accidental disabling of the watchdog, the Control Register (CTRL) must be written
twice, first with the KEY field set to 0x55, then 0xAA without changing the other bits. Failure to
do so will cause the write operation to be ignored, and the value in the CTRL Register will not be
changed.
15.5.1.2
Changing CLK_CNT Clock Source
After any reset, except for watchdog reset, CLK_CNT will be enabled with the RCSYS as
source.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| R83C154DXXX-20D | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CQCC44 |
| R80C52EXXX-16D | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
| IF8680A | 8-BIT, 8 MHz, MICROCONTROLLER, PQFP160 |
| IL250-X017 | 1 CHANNEL AC INPUT-TRANSISTOR OUTPUT OPTOCOUPLER |
| ILD250-X001 | 2 CHANNEL AC INPUT-TRANSISTOR OUTPUT OPTOCOUPLER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MQ80C154-20 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller |
| MQ80C154-25 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller |
| MQ80C154-30 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller |
| MQ80C154-36 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller |
| MQ80C154-L16 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller |
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