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參數(shù)資料
| 型號： | MPC962309EJ-1H |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 11/18頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC BUFFER ZD 1:5 3.3V 16-TSSOP |
| 標準包裝： | 96 |
| 類型： | 扇出緩沖器（分配），零延遲緩沖 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS |
| 輸出： | LVCMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:9 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 133.33MHz |
| 除法器/乘法器： | 無/無 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 16-TSSOP |
| 包裝： | 管件 |
MPC962305 REVISION 8 JANUARY 8, 2013
2
2013 Integrated Device Technology, Inc.
MPC962305 Data Sheet
LOW-COST, 3.3V ZERO DELAY BUFFEr
Table 1. Pin Description for MPC962309
Pin
Signal
Description
1REF(1)
1. Weak pull-down.
Input reference frequency, 5 V-tolerant input
2
CLKA1(2)
2. Weak pull-down on all outputs.
Buffered clock output, Bank A
3
CLKA2(2)
Buffered clock output, Bank A
4VDD
3.3 V supply
5
GND
Ground
6
CLKB1(2)
Buffered clock output, Bank B
7
CLKB2(2)
Buffered clock output, Bank B
8S2(3)
3. Weak pull-ups on these inputs.
Select input, bit 2
9S1(3)
Select input, bit 1
10
CLKB3(2)
Buffered clock output, Bank B
11
CLKB4(2)
Buffered clock output, Bank B
12
GND
Ground
13
VDD
3.3 V supply
14
CLKA3(2)
Buffered clock output, Bank A
15
CLKA4(2)
Buffered clock output, Bank A
16
CLKOUT(2)
Buffered output, internal feedback on this pin
Table 2. Pin Description for MPC962305
Pin
Signal
Description
1
REF(1)
1. Weak pull-down.
Input reference frequency, 5 V-tolerant input
2
CLK2(2)
2. Weak pull-down on all outputs.
Buffered clock output
3
CLK1(2)
Buffered clock output
4
GND
Ground
5
CLK3(2)
Buffered clock output
6
VDD
3.3 V supply
7
CLK4(2)
Buffered clock output
8
CLKOUT(2)
Buffered clock output, internal feedback on this pin
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
CLKOUT
CLKA4
CLKA3
VDD
GND
CLKB4
CLKB3
S1
REF
CLKA1
CLKA2
VDD
GND
CLKB1
CLKB2
S2
SOIC/TSSOP
Top View
Pin Configuration
CLKA2
CLKA3
CLKA4
CLKB1
CLKB2
CLKB3
CLKB4
CLKOUT
PLL
MUX
Select Input
Decoding
S2
S1
REF
Block Diagram
1
2
3
4
8
7
6
5
CLKOUT
CLK4
VDD
CLK3
REF
CLK2
CLK1
GND
SOIC/TSSOP
Top View
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MPC9653AACR2 | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
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