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參數(shù)資料
| 型號： | MPC961PACR2 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 961 SERIES, PLL BASED CLOCK DRIVER, 17 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
| 封裝： | PLASTIC, LQFP-32 |
| 文件頁數(shù)： | 3/10頁 |
| 文件大?。?/td> | 348K |
| 代理商： | MPC961PACR2 |
5
MPC961P
MOTOROLA ADVANCED CLOCK DRIVERS DEVICE DATA
487
Q5
Q4
Q3
GND
Q2
Q1
VCC
Q12
Q13
Q14
GND
Q15
VCC
Q6
Q7
Q8
GND
Q9
Q10
Q1
1
GND
PCLK
F_RANGE
VCCA
OE
FB_IN
VCC
25
26
27
28
29
30
31
32
15
14
13
12
11
10
9
12345
678
24
23
22
21
20
19
18
17
16
MPC961P
Figure 2. 32–Lead Pinout (Top View)
Q0
Q16
QFB
Table 1: PIN CONFIGURATIONS
Pin
I/O
Type
Function
PCLK, PCLK
Input
LVCMOS
PLL reference clock signal
FB_IN
Input
LVCMOS
PLL feedback signal input, connect to a QFB output
F_RANGE
Input
LVCMOS
PLL frequency range select
OE
Input
LVCMOS
Output enable/disable
Q0 - Q16
Output
LVCMOS
Clock outputs
QFB
Output
LVCMOS
PLL feedback signal output, connect to a FB_IN
GND
Supply
Ground
Negative power supply
VCCA
Supply
VCC
PLL positive power supply (analog power supply). The MPC961P requires an
external RC filter for the analog power supply pin VCCA. Please see applica-
tions section for details.
VCC
Supply
VCC
Positive power supply for I/O and core
Table 2: FUNCTION TABLE
Control
Default
0
1
F_RANGE
0
PLL high frequency range. MPC961P input reference
and output clock frequency range is 100 – 200 MHz
PLL low frequency range. MPC961P input reference
and output clock frequency range is 50 – 100 MHz
OE
0
Outputs enabled
Outputs disabled (high–impedance state)
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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