參數(shù)資料
型號(hào)： MPC862P
廠商： Motorola, Inc.
英文描述： XC2VP20-6FFG896C
中文描述： 硬件規(guī)格
文件頁數(shù)： 53/88頁
文件大小： 1104K
代理商： MPC862P
MOTOROLA
MPC862/857T/857DSL Hardware Specifications
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53
CPM Electrical Characteristics
Figure 52. SI Receive Timing Diagram with Normal Clocking (DSC = 0)
83a
L1RCLK, L1TCLK width high (DSC = 1)
3
P + 10
—
ns
84
L1CLK edge to L1CLKO valid (DSC = 1)
—
30.00
ns
85
L1RQ valid before falling edge of L1TSYNC
4
1.00
—
L1TCL
K
86
L1GR setup time
2
42.00
—
ns
87
L1GR hold time
42.00
—
ns
88
L1CLK edge to L1SYNC valid (FSD = 00) CNT = 0000, BYT =
0, DSC = 0)
—
0.00
ns
1
The ratio SyncCLK/L1RCLK must be greater than 2.5/1.
2
These specs are valid for IDL mode only.
3
Where P = 1/CLKOUT. Thus for a 25-MHz CLKO1 rate, P = 40 ns.
4
These strobes and TxD on the first bit of the frame become valid after L1CLK edge or L1SYNC, whichever is later.
Table 19. SI Timing (continued)
Num
Characteristic
All Frequencies
Unit
Min
Max
L1RXD
(Input)
L1RCLK
(FE=0, CE=0)
(Input)
L1RCLK
(FE=1, CE=1)
(Input)
L1RSYNC
(Input)
L1ST(4-1)
(Output)
71
72
70
71a
RFSD=1
75
73
74
77
78
76
79
BIT0
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
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