參數(shù)資料
型號(hào)： MPC8560PX833JB
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 833 MHz, RISC PROCESSOR, PBGA783
封裝： 29 X 29 MM, 3.75 MM HEIGHT, 1 MM PITCH, PLASTIC, FCBGA-783
文件頁(yè)數(shù)： 46/104頁(yè)
文件大?。?/td> 1244K
代理商： MPC8560PX833JB
MPC8560 Integrated Processor Hardware Specifications, Rev. 5
46
Freescale Semiconductor
CPM
Figure 28 shows the SCC/SPI internal clock.
Figure 28. SCC/SPI AC Timing Internal Clock Diagram
Figure 29 shows TDM input and output signals.
Figure 29. TDM Signal AC Timing Diagram
Table 36 shows CPM I2C AC Timing.
Table 36. CPM I2C AC Timing
Characteristic
Symbol
Min
Max
Unit
SCL clock frequency (slave)
fSCL
0FMAX
1
Hz
SCL clock frequency (master)
fSCL
BRGCLK/16512
BRGCLK/48
Hz
Bus free time between transmissions
tSDHDL
1/(2.2 * fSCL)—
s
Low period of SCL
tSCLCH
1/(2.2 * fSCL)—
s
High period of SCL
tSCHCL
1/(2.2 * fSCL)—
s
Start condition setup time 2
tSCHDL
2/(divider * fSCL)
—
s
Start condition hold time 2
tSDLCL
3/(divider * fSCL)—
s
Data hold time 2
tSCLDX
2/(divider * fSCL)—
s
Data setup time 2
tSDVCH
3/(divider * fSCL)—
s
BRG_OUT
tNIIXKH
tNIKHOX
Input Signals:
SCC/SPI
(See Note)
Output Signals:
SCC/SPI
(See Note)
Note: The clock edge is selectable on SCC and SPI.
tNIIVKH
Serial Clock In
tTDKHOX
TDM Input Signals
There are 4 possible TDM timing conditions:
tTDIVKH
tTDIXKH
TDM Output Signals
Note:
1.
2.
3.
4.
Input sampled on the rising edge and output driven on the rising edge (shown).
Input sampled on the rising edge and output driven on the falling edge.
Input sampled on the falling edge and output driven on the falling edge.
Input sampled on the falling edge and output driven on the rising edge.
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PDF描述
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