參數(shù)資料
型號： MPC850SAR
廠商： Motorola, Inc.
英文描述： Communications Controller Hardware Specifications
中文描述： 通信控制器的硬件規(guī)格
文件頁數(shù)： 37/68頁
文件大小： 384K
代理商： MPC850SAR
MOTOROLA
MPC850 (Rev. A/B/C) Hardware Specifications
37
Layout Practices
Figure 32 provides the reset timing for the data bus weak drive during configuration.
Figure 32. Reset Timing—Data Bus Weak Drive during Configuration
Figure 33 provides the reset timing for the debug port configuration.
Figure 33. Reset Timing—Debug Port Configuration
Part VII IEEE 1149.1 Electrical Specifications
Table 12 provides the JTAG timings for the MPC850 as shown in Figure 34 to Figure 37.
Table 12. JTAG Timing
Num
Characteristic
50 MHz
66MHz
80 MHz
Unit
Min
Max
Min
Max
Min
Max
J82
TCK cycle time
100.00
—
100.00
—
100.00
—
ns
J83
TCK clock pulse width measured at 1.5 V
40.00
—
40.00
—
40.00
—
ns
J84
TCK rise and fall times
0.00
10.00
0.00
10.00
0.00
10.00
ns
J85
TMS, TDI data setup time
5.00
—
5.00
—
5.00
—
ns
CLKOUT
HRESET
D[0:31] (OUT)
(Weak)
RSTCONF
R69
R79
R77
R78
CLKOUT
SRESET
DSCK, DSDI
R70
R82
R80
R80
R81
R81
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