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參數(shù)資料
| 型號(hào)： | MMC2107PV |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | HCMOS Microcontroller Unit |
| 中文描述： | 32-BIT, FLASH, 33 MHz, RISC MICROCONTROLLER, PQFP144 |
| 封裝： | 20 X 20 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, LQFP-144 |
| 文件頁數(shù)： | 500/618頁 |
| 文件大?。?/td> | 7373K |
| 代理商： | MMC2107PV |
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Technical Data
MMC2107 – Rev. 2.0
500
Queued Analog-to-Digital Converter (QADC)
For More Information On This Product,
Go to: www.freescale.com
MOTOROLA
Queued Analog-to-Digital Converter (QADC)
18.12 Interrupts
The four interrupt lines are outputs of the module and have no priority or
arbitration within the module.
18.12.1 Interrupt Operation
QADC inputs can be monitored by polling or by using interrupts. When
interrupts are not needed, software can disable the pause and
completion interrupts and monitor the completion flag and the pause flag
for each queue in the status register (QASR). In other words, flag bits
can be polled to determine when new results are available.
Table 18-18
shows the status flag and interrupt enable bits which
correspond to queue 1 and queue 2 activity.
If interrupts are enabled for an event, the QADC requests interrupt
service when the event occurs. Using interrupts does not require
continuously polling the status flags to see if an event has taken place.
Table 18-17. Error Resulting From Input Leakage (I
Off
)
Source Impedance
Leakage Value (10-Bit Conversions)
100 nA
200 nA
500 nA
1000 nA
1 k
—
—
0.1 counts
0.2 counts
10 k
0.2 counts
0.4 counts
1 counts
2 counts
100 k
2 counts
4 count
10 counts
20 counts
Table 18-18. QADC Status Flags and Interrupt Sources
Queue
Queue Activity
Status
Flag
Interrupt
Enable Bit
Queue 1
Result written to last CCW in queue 1
CF1
CIE1
Result written for a CCW with pause bit set in
queue 1
PF1
PIE1
Queue 2
Result written to last CCW in queue 2
CF2
CIE2
Result written for a CCW with pause bit set in
queue 2
PF2
PIE2
F
Freescale Semiconductor, Inc.
n
.
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