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參數(shù)資料
| 型號(hào)： | ML9042-XXCVWA |
| 廠商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分類： | 顯示控制器 |
| 英文描述： | 17 X 100 DOTS DOT MAT LCD DRVR AND DSPL CTLR, UUC233 |
| 封裝： | DIE-233 |
| 文件頁數(shù)： | 24/59頁 |
| 文件大?。?/td> | 589K |
| 代理商： | ML9042-XXCVWA |
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FEDL9042-01
OKI Semiconductor
ML9042-xx
29/58
Serial Interface Mode
In the Serial I/F Mode, the ML9042 interfaces with the CPU via the RS0/CSB, E/SHTB, RW/SI, and DB0(SO)
pins.
Writing and reading operations are executed in units of 16 bits after the RS0/CSB signal falls down. If the RS0/CSB
signal rises up before the completion of 16-bit unit access, this access is ignored.
When the BF bit is “1”, the ML9042 cannot accept any other instructions. Before inputting a new instruction,
check that the BF bit is “0”. Any access when the BF bit is “1” is ignored.
Data format is LSB-first.
Examples of Access in the Serial I/F Mode
Note 1: Higher 5 bits of each instruction must be input at a “H” level.
Note 2: Lower 8 bits are “don’t care” when the instructions in the READ MODE are set.
Note 3: After one instruction is input, the next instruction must be input after the RS0/CSB pin is pulled at a “H”
level.
1) WRITE MODE
RS0/CSB
E/SHTB
BUSY
RWB/SI
DB(SO)
2) READ MODE
RS0/CSB
E/SHTB
BUSY
RWB/SI
DB(SO)
(Internal operation)
12
345678
1
13
14
15
16
9
101112
11111
R/
W RS0 RS1
D0
D1
D2
D3
D4
D5
D6
D7
1
3456789
10
11
12
13
14
15
16
1
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R/
W RS0 RS1
1
D0
D1
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D7
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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