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參數(shù)資料
| 型號： | ML674001TC |
| 廠商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 33.333 MHz, RISC MICROCONTROLLER, PQFP144 |
| 封裝： | 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144 |
| 文件頁數(shù)： | 264/440頁 |
| 文件大?。?/td> | 2769K |
| 代理商： | ML674001TC |
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ML674001 Seies/ML675001 Series User’s Manual
Chapter 20
I2C
20-12
20.3 Operations
The following is a function description of the I2C block operation. Through out this section, I2C bus transfer
illustrations are used as visual aides. Use the following legend for all of the illustrations in this section.
20.3.1
Transmit operation (transfer of 1 byte from master to slave, in 7-bit address mode)
To identify the communication destination, the address of the communication destination (slave) is written to
SAD[6:0] of the I2CSAD register, and to set the transfer direction as transmission, the I2CRW bit is set to
"0" (transmitted by the master device).
Write transmit data to the I2CDR register.
The I2CCON register is set to XXX0X100.
The following series of operations is automatically performed
when the STCM bit (bit 2 of the I2CCON register) is set to "1": Transmission of the start sequence (to attain
bus access), transmission of the slave address and the transfer direction specified to the I2CSAD register,
confirmation of an acknowledge from the slave device for the address transmitted, transmission of the
transmit data written to the I2CDR register, and confirmation of an acknowledge from the slave device for
the data transmitted.
Also, when the I2COC bit (bit 1 of the I2CCON register) is set to "0", the stop
sequence is successively transmitted (the bus is released) and communication is then finished.
At this
point, the I2CIR bit is set to "1," indicating that the transmission of 1-byte of data has been finished.
If
acknowledges for the address and data transmitted have not been returned normally, both the I2CAAK and
I2CDAK bits are set to "1" upon completion of transmission.
I2CSAD = xxxxxxx0b
I2CDR = xxxxxxxxb
I2CCON = xxx0x100b
Register
settings
Transmission complete
I2CSAD
I2CDR
Flag
I2CIR = 1
(I2CAAK = 0)
(I2CDAK = 0)
S B
7
B
6
B
5
B
4
B
3
B
2
B
1
B
0
A B
7
B
6
B
5
B
4
B
3
B
2
B
1
A P
Output
S
P
S
r
A
Input
Start
sequence
Stop
sequence
Restart
sequence
Acknowledge
received
Negative
acknowledge
received
Acknowledge
transmitted
Negative
acknowledge
transmitted
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ML674001LA | 32-BIT, MROM, 33.333 MHz, RISC MICROCONTROLLER, PBGA144 |
| ML67Q4003LA | 32-BIT, FLASH, 33.333 MHz, RISC MICROCONTROLLER, PBGA144 |
| ML67Q4002LA | 32-BIT, FLASH, 33.333 MHz, RISC MICROCONTROLLER, PBGA144 |
| ML67Q4003TC | 32-BIT, FLASH, 33.333 MHz, RISC MICROCONTROLLER, PQFP144 |
| ML67Q4002TC | 32-BIT, FLASH, 33.333 MHz, RISC MICROCONTROLLER, PQFP144 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| ML675001ALAZ03A | 制造商:ROHM Semiconductor 功能描述:ARM7TDMI 32-BIT MCU 60 MHZ ROH |
| ML675001ATC | 制造商:ROHM Semiconductor 功能描述: |
| ML675001ATCZ03A | 制造商:ROHM Semiconductor 功能描述: |
| ML675001LA | 制造商:ROHM Semiconductor 功能描述: |
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