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參數(shù)資料
| 型號(hào)： | MJ80C32U-25:D |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER |
| 文件頁(yè)數(shù)： | 74/109頁(yè) |
| 文件大?。?/td> | 10824K |
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52
ATtiny20 [DATASHEET]
8235E–AVR–03/2013
Table 10-4. Overriding Signals for Alternate Functions in PA[7:5]
Note:
When TWI is enabled the slew rate control and spike filter are activated on PA7. This is not illustrated in Figure 10-6 on
page 48. The spike filter is connected between AIOxn and the TWI module.
Table 10-5. Overriding Signals for Alternate Functions in PA[4:2]
Signal
Name
PA7/ADC7/OC0B/ICP1/
T1/SCL/SCK/PCINT7
PA6/ADC6/SS/PCINT6
PA5/ADC5/PCINT5
PUOE
0
PUOV
0
DDOE
TWEN + (SPE MSTR)
SPE MSTR
0
DDOV
TWEN SCL_OUT
0
PVOE
TWEN + (SPE MSTR) +
OC0B_ENABLE
0
PVOV
TWEN (SPE MSTR SCK_OUT
+ (SPE + MSTR) OC0B)
0
PTOE
0
DIEOE
PCINT7 PCIE0 + ADC7D
PCINT6 PCIE0 + ADC6D
PCINT5 PCIE0 + ADC5D
DIEOV
PCINT7 PCIE0
PCINT6 PCIE0
PCINT5 PCIE0
DI
ICP1 / SCK / T1 / SCL / PCINT7
Input
SPI SS / PCINT6 Input
AIO
ADC7 / SCL Input
ADC6 Input
ADC5 Input
Signal
Name
PA4/ADC4/PCINT4
PA3/ADC3/PCINT3
PA2/ADC2/AIN1/PCINT2
PUOE
0
PUOV
0
DDOE
0
DDOV
0
PVOE
0
PVOV
0
PTOE
0
DIEOE
(PCINT4 PCIE0) + ADC4D
(PCINT3 PCIE0) + ADC3D
(PCINT2 PCIE0) + ADC2D
DIEOV
(PCINT4 PCIE0)
PCINT3 PCIE0
DI
PCINT4 input
PCINT1 Input
PCINT0 Input
AIO
ADC4 Input
ADC3 Input
ADC2 / Analog Comparator
Negative Input
相關(guān)PDF資料 |
PDF描述 |
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