參數資料
型號： MCIMX253DVM4
廠商： Freescale Semiconductor
文件頁數： 20/153頁
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描述： IC MPU I.MX25 COMM 400MAPBGA
標準包裝： 90
系列： i.MX25
核心處理器： ARM9
芯體尺寸： 32-位
速度： 400MHz
連通性： 1 線，EBI/EMI，以太網，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG
外圍設備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數： 128
程序存儲器類型： 外部程序存儲器
RAM 容量： 144K x 8
電壓 - 電源 (Vcc/Vdd)： 1.15 V ~ 1.52 V
數據轉換器： A/D 3x12b
振蕩器型： 外部
工作溫度： -20°C ~ 70°C
封裝/外殼： 400-LFBGA
包裝： 托盤
i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 10
116
Freescale Semiconductor
3.7.19.2
UART Infrared (IrDA) Mode Timing
The following subsections describe the UART transmit and receive timing in IrDA mode.
3.7.19.2.3
UART IrDA Mode Transmit Timing
Figure 87 depicts the UART transmit timing in IrDA mode, showing only 8 data bits and 1 stop bit.
Table 88 describes the timing parameters (UA3–UA4) shown in the figure.
Figure 87. UART IrDA Mode Transmit Timing Diagram
3.7.19.2.4
UART IrDA Mode Receive Timing
Figure 88 shows the UART receive timing for IrDA mode, for a format of 8 data bits and 1 stop bit.
Table 89 describes the timing parameters (UA5–UA6) shown in the figure.
Figure 88. UART IrDA Mode Receive Timing Diagram
Table 88. UART IrDA Mode Transmit Timing Parameters
ID
Parameter
Symbol
Min.
Max.
Units
UA3
Transmit bit time in IrDA mode
tTIRbit
1/Fbaud_rate
1 – T
ref_clk
2
1 F
baud_rate: Baud rate frequency. The maximum baud rate the UART can support is (ipg_perclk frequency)/16.
2 T
ref_clk: The period of UART reference clock ref_clk (ipg_perclk after RFDIV divider).
1/Fbaud_rate + Tref_clk
—
UA4
Transmit IR pulse duration
tTIRpulse
(3/16)
× (1/Fbaud_rate) – Tref_clk (3/16) × (1/Fbaud_rate) + Tref_clk
—
Table 89. UART IrDA Mode Receive Timing Parameters
ID
Parameter
Symbol
Min.
Max.
Units
UA5
Receive bit time1 in IrDA mode
1 The UART receiver can tolerate 1/(16 × Fbaud_rate) tolerance in each bit. But accumulation tolerance in one frame must not
exceed 3/(16
× Fbaud_rate).
tRIRbit
1/Fbaud_rate
2 – 1/(16 × Fbaud_rate)1/Fbaud_rate + 1/(16 × Fbaud_rate)—
UA6
Receive IR pulse duration
tRIRpulse
1.41
μs
(5/16)
× (1/Fbaud_rate)—
Bit 1
Bit 2
Bit 0
Bit 4
Bit 5
Bit 6
Bit 7
TXD
(output)
Bit 3
Start
Bit
STOP
BIT
Possible
Parity
Bit
UA3
UA4
Bit 1
Bit 2
Bit 0
Bit 4
Bit 5
Bit 6
Bit 7
RXD
(input)
Bit 3
Start
Bit
STOP
BIT
Possible
Parity
Bit
UA5
UA6
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