參數(shù)資料
型號： MCHLC705KJ1CDWE
廠商： Freescale Semiconductor
文件頁數(shù)： 81/108頁
文件大?。?/td> 0K
描述： IC MCU 8BIT 64 BYTES RAM 16-SOIC
標準包裝： 47
系列： HC05
核心處理器： HC05
芯體尺寸： 8-位
速度： 4MHz
外圍設備： POR，WDT
輸入/輸出數(shù)： 10
程序存儲器容量： 1.2KB（1.2K x 8）
程序存儲器類型： OTP
RAM 容量： 64 x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 16-SOIC（0.295"，7.50mm 寬）
包裝： 管件
Resets and Interrupts
MC68HC705KJ1 MC68HRC705KJ1 MC68HLC705KJ1 Data Sheet, Rev. 4.1
74
Freescale Semiconductor
Figure 8-4. External Interrupt Logic
Figure 8-5. External Interrupt Timing
Table 8-2. External Interrupt Timing (VDD = 5.0 Vdc)
(1)
1. VDD = 5.0 Vdc ±10%, VSS = 0 Vdc, TA = –40°C to +85°C, unless otherwise noted.
Characteristic
Symbol
Min
Max
Unit
Interrupt Pulse Width Low (Edge-Triggered)
tILIH
125
—
ns
Interrupt Pulse Period
tILIL
Note(2)
2. The minimum tILIL should not be less than the number of interrupt service routine cycles plus 19 tcyc.
—
tcyc
Table 8-3. External Interrupt Timing (VDD = 3.3 Vdc)
(1)
1. VDD = 3.3 Vdc ±10%, VSS = 0 Vdc, TA = –40°C to +85°C unless otherwise noted.
Characteristic
Symbol
Min
Max
Unit
Interrupt Pulse Width Low (Edge-Triggered)
tILIH
250
—
ns
Interrupt Pulse Period
tILIL
Note(2)
2. The minimum tILIL should not be less than the number of interrupt service routine cycles plus 19 tcyc.
—
tcyc
PIRQ
LEVEL-SENSITIVE TRIGGER
PA3
PA2
PA1
IRQ
PA0
VDD
(MOR LEVEL BIT)
RESET
IRQ VECTOR FETCH
EXTERNAL
INTERRUPT
REQUEST
(MOR)
TO BIH & BIL
INSTRUCTION
PROCESSING
IRQF
IRQR
IRQE
DQ
CK
IRQ
CLR
LATCH
IRQ
tILIH
tILIL
tILIH
EXT. INT. PIN
EXT. INT. PIN1
EXT. INT. PINn
.
(INTERNAL)
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PDF描述
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