參數(shù)資料
型號(hào)： MCF5270AB100
廠商： 飛思卡爾半導(dǎo)體(中國(guó))有限公司
英文描述： Integrated Microprocessor Hardware Specification
中文描述： 集成的微處理器，硬件規(guī)格
文件頁數(shù)： 24/40頁
文件大小： 863K
代理商： MCF5270AB100
MCF5271 Integrated Microprocessor Hardware Specification, Rev. 2
Preliminary Electrical Characteristics
Freescale Semiconductor
24
Read/write bus timings listed in
Table 12
are shown in
Figure 7
,
Figure 8
, and
Figure 9
.
Figure 7. Read/Write (Internally Terminated) SRAM Bus Timing
B9
CLKOUT high to address (A[23:0]) and control (TS,
TSIZ[1:0], TIP, R/W) invalid
t
CHAI
1.5
—
ns
Data Outputs
B11
CLKOUT high to data output (D[31:0]) valid
t
CHDOV
—
9
ns
B12
CLKOUT high to data output (D[31:0]) invalid
t
CHDOI
1.5
—
ns
B13
CLKOUT high to data output (D[31:0]) high impedance
t
CHDOZ
—
9
ns
1
2
3
CS transitions after the falling edge of CLKOUT.
BS transitions after the falling edge of CLKOUT.
OE transitions after the falling edge of CLKOUT.
Table 12. External Bus Output Timing Specifications (continued)
Name
Characteristic
Symbol
Min
Max
Unit
B12
B13
B8
CLKOUT
CSn
A[23:0]
TSIZ[1:0]
R/W
BS[3:0]
D[31:0]
TA
(H)
(H)
S0
S2
S3
S1
S4
S5
S0
S1
S2
S3
S4
S5
TEA (H)
B6a
B8
B7a
B6c
B7
B6b
B7
B4
B5
B11
B9
B9
B6b
OE
B0
B7
B9
TS
TIP
B8
B8
B9
B8
B9
B7a
B6a
B8
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