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參數(shù)資料
| 型號： | MCF52277CVM160J |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 29/46頁 |
| 文件大小： | 0K |
| 描述： | IC MCU V2 32BIT 196MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 126 |
| 系列： | MCF5227x |
| 核心處理器： | Coldfire V2 |
| 芯體尺寸： | 32-位 |
| 速度： | 166.67MHz |
| 連通性： | CAN，EBI/EMI，I²C，SPI，SSI，UART/USART，USB OTG |
| 外圍設(shè)備： | DMA，LCD，PWM，WDT |
| 輸入/輸出數(shù)： | 55 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 128K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.4 V ~ 1.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 196-LBGA |
| 包裝： | 托盤 |
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Electrical Characteristics
MCF5227x ColdFire Microprocessor Data Sheet, Rev. 8
Freescale Semiconductor
35
S5
SSI_BCLK to SSI_FS output valid
—
10
ns
S6
SSI_BCLK to SSI_FS output invalid
0
—
ns
S7
SSI_BCLK to SSI_TXD valid
—
10
ns
S8
SSI_BCLK to SSI_TXD invalid / high impedence
0
—
ns
S9
SSI_RXD / SSI_FS input setup before SSI_BCLK
10
—
ns
S10
SSI_RXD / SSI_FS input hold after SSI_BCLK
0
—
ns
1 All timings specified with a capactive load of 25pF.
2 SSI_MCLK can be generated from SSI_CLKIN or a divided version of the internal system clock (SYSCLK).
3 SSI_BCLK can be derived from SSI_CLKIN or a divided version of SYSCLK. If the SYSCLK is used, the minimum
divider is 6. If the SSI_CLKIN input is used, the programmable dividers must be set to ensure that SSI_BCLK does not
exceed 4 x fSYS.
Table 27. SSI Timing—Slave Modes1
1 All timings specified with a capactive load of 25 pF.
Num
Characteristic
Symbol
Min
Max
Unit
Notes
S11
SSI_BCLK cycle time
tBCLK
4
× 1/f
SYS
—ns
S12
SSI_BCLK pulse width high / low
45%
55%
tBCLK
S13
SSI_FS input setup before SSI_BCLK
10
—
ns
S14
SSI_FS input hold after SSI_BCLK
2
—
ns
S15
SSI_BCLK to SSI_TXD / SSI_FS output valid
—
10
ns
S16
SSI_BCLK to SSI_TXD / SSI_FS output invalid / high
impedence
0—
ns
S17
SSI_RXD setup before SSI_BCLK
10
—
ns
S18
SSI_RXD hold after SSI_BCLK
2
—
ns
Table 26. SSI Timing—Master Modes1 (continued)
Num
Characteristic
Symbol
Min
Max
Unit
Notes
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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