參數(shù)資料
型號： MC9S12C32VPB
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP52
封裝： LQFP-52
文件頁數(shù)： 36/94頁
文件大小： 906K
代理商： MC9S12C32VPB
Device User Guide — 9S12C32DGV1/D V01.01
41
5.3 Resets
Resets are a subset of the interrupts featured inTable 5-1. The different sources capable of generating a
system reset are summarized in Table 5-2.
5.3.1 Reset Summary Table
5.3.2 Effects of Reset
When a reset occurs, MCU registers and control bits are changed to known start-up states. Refer to the
respective module Block User Guides for register reset states. Refer to the HCS12 Core User Guides for
mode dependent pin configuration of port A, B and E out of reset.
Refer to the PIM Block User Guide for reset configurations of all peripheral module ports.
Refer to Table 1-1 for locations of the memories depending on the operating mode after reset.
The RAM array is not automatically initialized out of reset.
$FFD0, $FFD1
Reserved
$FFCE, $FFCF
Port J
I-Bit
PTJIF (PTJIE)
$CE
$FFCC, $FFCD
Reserved
$FFCA, $FFCB
Reserved
$FFC8, $FFC9
Reserved
$FFC6, $FFC7
CRG PLL lock
I-Bit
PLLCR (LOCKIE)
$C6
$FFC4, $FFC5
CRG Self Clock Mode
I-Bit
PLLCR (SCMIE)
$C4
$FFBA to $FFC3
Reserved
$FFB8, $FFB9
FLASH
I-Bit
FCTL (CCIE, CBEIE)
$B8
$FFB6, $FFB7
CAN wake-up
I-Bit
CANRIER (WUPIE)
$B6
$FFB4, $FFB5
CAN errors
I-Bit
CANRIER (CSCIE, OVRIE)
$B4
$FFB2, $FFB3
CAN receive
I-Bit
CANRIER (RXFIE)
$B2
$FFB0, $FFB1
CAN transmit
I-Bit
CANTIER (TXEIE[2:0])
$B0
$FF90 to $FFAF
Reserved
$FF8E, $FF8F
Port P
I-Bit
PTPIF (PTPIE)
$8E
$FF8C, $FF8D
PWM Emergency Shutdown
I-Bit
PWMSDN(PWMIE)
$8C
$FF8A, $FF8B
VREG LVI
I-Bit
CTRL0 (LVIE)
$8A
$FF80 to $FF89
Reserved
Table 5-2 Reset Summary
Reset
Priority
Source
Vector
Power-on Reset
1
CRG Module
$FFFE, $FFFF
External Reset
1
RESET pin
$FFFE, $FFFF
Low Voltage Reset
1
VREG Module
$FFFE, $FFFF
Clock Monitor Reset
2
CRG Module
$FFFC, $FFFD
COP Watchdog Reset
3
CRG Module
$FFFA, $FFFB
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PDF描述
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