參數(shù)資料
型號(hào): MC9S08QD4CPC
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PDIP8
封裝: ROHS COMPLIANT, PLASTIC, DIP-8
文件頁數(shù): 36/198頁
文件大小: 2473K
代理商: MC9S08QD4CPC
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Internal Clock Source (S08ICSV1)
MC9S08QD4 Series MCU Data Sheet, Rev. 6
130
Freescale Semiconductor
times the filter frequency, as selected by the RDIV bits, so that the ICSLCLK will be available for BDC
communications, and the external reference clock is enabled.
9.4.1.6
FLL Bypassed External Low Power (FBELP)
The FLL bypassed external low power (FBELP) mode is entered when all the following conditions occur:
CLKS bits are written to 10.
IREFS bit is written to 0.
BDM mode is not active and LP bit is written to 1.
In FLL bypassed external low power mode, the ICSOUT clock is derived from the external reference clock
and the FLL is disabled. The ICSLCLK will be not be available for BDC communications. The external
reference clock is enabled.
9.4.1.7
Stop
Stop mode is entered whenever the MCU enters a STOP state. In this mode, all ICS clock signals are static
except in the following cases:
ICSIRCLK will be active in stop mode when all the following conditions occur:
IRCLKEN bit is written to 1
IREFSTEN bit is written to 1
ICSERCLK will be active in stop mode when all the following conditions occur:
ERCLKEN bit is written to 1
EREFSTEN bit is written to 1
9.4.2
Mode Switching
When switching between FLL engaged internal (FEI) and FLL engaged external (FEE) modes the IREFS
bit can be changed at anytime, but the RDIV bits must be changed simultaneously so that the resulting
frequency stays in the range of 31.25 kHz to 39.0625 kHz. After a change in the IREFS value the FLL will
begin locking again after a few full cycles of the resulting divided reference frequency.
The CLKS bits can also be changed at anytime, but the RDIV bits must be changed simultaneously so that
the resulting frequency stays in the range of 31.25 kHz to 39.0625 kHz. The actual switch to the newly
selected clock will not occur until after a few full cycles of the new clock. If the newly selected clock is
not available, the previous clock will remain selected.
9.4.3
Bus Frequency Divider
The BDIV bits can be changed at anytime and the actual switch to the new frequency will occur
immediately.
相關(guān)PDF資料
PDF描述
MC9S08QD2CPC 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PDIP8
MC9S08QD2VPC 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PDIP8
MC9S08QE128CQD 8-BIT, FLASH, 50.33 MHz, MICROCONTROLLER, PQFP44
MC9S08QE128CLC 8-BIT, FLASH, 50.33 MHz, MICROCONTROLLER, PQFP32
MC9S08QE64CQD 8-BIT, FLASH, 50.33 MHz, MICROCONTROLLER, PQFP44
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參數(shù)描述
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