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參數(shù)資料
| 型號： | MC9S08GT32ACBE |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 74/302頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 32K FLASH 2K RAM 42-SDIP |
| 標(biāo)準(zhǔn)包裝： | 13 |
| 系列： | S08 |
| 核心處理器： | S08 |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | I²C，SCI，SPI |
| 外圍設(shè)備： | LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 33 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 42-SDIP（0.600"，15.24mm） |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 729 (CN2011-ZH PDF) |
| 配用： | M68DEMO908GB60E-ND - BOARD DEMO MC9S08GB60 M68EVB908GB60E-ND - BOARD EVAL FOR MC9S08GB60 |
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Timer/PWM (TPM)
MC9S08GB60A Data Sheet, Rev. 2
Freescale Semiconductor
165
10.7.1
Timer x Status and Control Register (TPMxSC)
TPMxSC contains the overflow status flag and control bits that are used to configure the interrupt enable,
TPM configuration, clock source, and prescale divisor. These controls relate to all channels within this
timer module.
76
54
321
0
RTOF
TOIE
CPWMS
CLKSB
CLKSA
PS2
PS1
PS0
W
Reset
000
00
000
= Unimplemented or Reserved
Figure 10-5. Timer x Status and Control Register (TPMxSC)
Table 10-1. TPMxSC Register Field Descriptions
Field
Description
7
TOF
Timer Overflow Flag — This flag is set when the TPM counter changes to $0000 after reaching the modulo
value programmed in the TPM counter modulo registers. When the TPM is configured for CPWM, TOF is set after
the counter has reached the value in the modulo register, at the transition to the next lower count value. Clear
TOF by reading the TPM status and control register when TOF is set and then writing a 0 to TOF. If another TPM
overflow occurs before the clearing sequence is complete, the sequence is reset so TOF would remain set after
the clear sequence was completed for the earlier TOF. Reset clears TOF. Writing a 1 to TOF has no effect.
0 TPM counter has not reached modulo value or overflow
1 TPM counter has overflowed
6
TOIE
Timer Overflow Interrupt Enable — This read/write bit enables TPM overflow interrupts. If TOIE is set, an
interrupt is generated when TOF equals 1. Reset clears TOIE.
0 TOF interrupts inhibited (use software polling)
1 TOF interrupts enabled
5
CPWMS
Center-Aligned PWM Select — This read/write bit selects CPWM operating mode. Reset clears this bit so the
TPM operates in up-counting mode for input capture, output compare, and edge-aligned PWM functions. Setting
CPWMS reconfigures the TPM to operate in up-/down-counting mode for CPWM functions. Reset clears
CPWMS.
0 All TPMx channels operate as input capture, output compare, or edge-aligned PWM mode as selected by the
MSnB:MSnA control bits in each channel’s status and control register
1 All TPMx channels operate in center-aligned PWM mode
4:3
CLKS[B:A]
Clock Source Select — As shown in Table 10-2, this 2-bit field is used to disable the TPM system or select one
of three clock sources to drive the counter prescaler. The external source and the XCLK are synchronized to the
bus clock by an on-chip synchronization circuit.
2:0
PS[2:0]
Prescale Divisor Select — This 3-bit field selects one of eight divisors for the TPM clock input as shown in
Table 10-3. This prescaler is located after any clock source synchronization or clock source selection, so it affects
whatever clock source is selected to drive the TPM system.
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參數(shù)描述 |
|---|---|
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| MC9S08GT32ACFBE | 制造商:Freescale Semiconductor 功能描述:8-BIT MICROCONTROLLER IC ((NW)) |
| MC9S08GT32ACFBE | 制造商:Freescale Semiconductor 功能描述:IC 8BIT 32K FLASH |
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| MC9S08GT32ACFBER-CUT TAPE | 制造商:Freescale 功能描述:MC9S08GT Series 2 KB RAM 32 KB Flash 20 MHz 8-Bit Microcontroller - QFP-44 |
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