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參數(shù)資料
| 型號： | MC908QY8 |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | To provide the most up-to-date information, the revision of our documents |
| 中文描述： | 為了提供最先進的最新資料，我們的文件修改 |
| 文件頁數(shù)： | 106/236頁 |
| 文件大小： | 1682K |
| 代理商： | MC908QY8 |
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Input/Output Ports (PORTS)
MC68HC908QB8 Data Sheet, Rev. 1
106
Freescale Semiconductor
12.2.4 Port A Summary Table
The following table summarizes the operation of the port A pins when used as a general-purpose
input/output pins.
12.3 Port B
Port B is an 8-bit special function port that shares its pins with the 4-channel timer interface module (TIM)
(see
Chapter 16 Timer Interface Module (TIM)
), the 10-bit ADC (see
Chapter 3 Analog-to-Digital
Converter (ADC10) Module
), the serial peripheral interface (SPI) module (see
Chapter 15 Serial
Peripheral Interface (SPI) Module
) and the enhanced serial communications interface (ESCI) module
(see
Chapter 13 Enhanced Serial Communications Interface (ESCI) Module
).
Each port B pin also has a software configurable pullup device if the corresponding port pin is configured
as an input port.
12.3.1 Port B Data Register
The port B data register (PTB) contains a data latch for each of the port B pins.
PTB[7:0] — Port B Data Bits
These read/write bits are software programmable. Data direction of each port B pin is under the control
of the corresponding bit in data direction register B. Reset has no effect on port B data.
Table 12-1. Port A Pin Functions
PTAPUE
Bit
DDRA
Bit
PTA
Bit
I/O Pin
Mode
Accesses to DDRA
Read/Write
Accesses to PTA
Read
Write
1
0
X
(1)
1. X = don’t care
2. I/O pin pulled to V
DD
by internal pullup.
3. Writing affects data register, but does not affect input.
4. Hi-Z = high impedance
5. Output does not apply to PTA2
Input, V
DD(2)
DDRA5–DDRA0
Pin
PTA5–PTA0
(3)
0
0
X
Input, Hi-Z
(4)
DDRA5–DDRA0
Pin
PTA5–PTA0
(3)
X
1
X
Output
DDRA5–DDRA0
PTA5–PTA0
PTA5–PTA0
(5)
Bit 7
6
5
4
3
2
1
Bit 0
Read:
PTB7
PTB6
PTB5
PTB4
PTB3
PTB2
PTB1
PTB0
Write:
Reset:
Unaffected by reset
Figure 12-5. Port B Data Register (PTB)
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