參數(shù)資料
型號(hào)： MC908AP32ACFBER
廠商： Freescale Semiconductor
文件頁數(shù)： 180/316頁
文件大?。?/td> 0K
描述： IC MCU 32K FLASH 8MHZ 44-QFP
標(biāo)準(zhǔn)包裝： 750
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： I²C，IRSCI，SCI，SPI
外圍設(shè)備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 32
程序存儲(chǔ)器容量： 32KB（32K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-QFP
包裝： 帶卷 (TR)
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Input/Output (I/O) Ports
MC68HC908AP A-Family Data Sheet, Rev. 3
260
Freescale Semiconductor
16.2 Port A
Port A is an 8-bit special-function port that shares all of its pins with the analog-to-digital converter (ADC)
module. Port A pins also have LED direct drive capability.
16.2.1 Port A Data Register (PTA)
The port A data register contains a data latch for each of the eight port A pins.
PTA[7:0] — Port A Data Bits
These read/write bits are software-programmable. Data direction of each port A pin is under the control
of the corresponding bit in data direction register A. Reset has no effect on port A data.
ADC7–ADC0 — ADC Channels 7 to 0
ADC7–ADC0 are pins used for the input channels to the analog-to-digital converter module. The
channel select bits, ADCH[4:0], in the ADC status and control register define which port pin will be used
as an ADC input and overrides any control from the port I/O logic.
NOTE
Care must be taken when reading port A while applying analog voltages to
ADC7–ADC0 pins. If the appropriate ADC channel is not enabled,
excessive current drain may occur if analog voltages are applied to the
PTAx/ADCx pin, while PTA is read as a digital input. Those ports not
selected as analog input channels are considered digital I/O ports.
LED drive — Direct LED drive pins
PTA7–PTA0 pins can be configured for direct LED drive. See 16.2.3 Port-A LED Control Register
16.2.2 Data Direction Register (DDRA)
Data direction register A determines whether each port A pin is an input or an output. Writing a logic 1 to
a DDRA bit enables the output buffer for the corresponding port A pin; a logic 0 disables the output buffer.
Address:
$0000
Bit 7
654321
Bit 0
Read:
PTA7
PTA6
PTA5
PTA4
PTA3
PTA2
PTA1
PTA0
Write:
Reset:
Unaffected by reset
Alternative Function:
ADC7
ADC6
ADC5
ADC4
ADC3
ADC2
ADC1
ADC0
Additional Function:
LED drive
Figure 16-2. Port A Data Register (PTA)
Address:
$0004
Bit 7
654321
Bit 0
Read:
DDRA7
DDRA6
DDRA5
DDRA4
DDRA3
DDRA2
DDRA1
DDRA0
Write:
Reset:
00000000
Figure 16-3. Data Direction Register A (DDRA)
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PDF描述
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