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參數(shù)資料
| 型號： | MC8641DVU1250HC |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 166.66 MHz, MICROPROCESSOR, CBGA1023 |
| 封裝： | 33 X 33 MM, ROHS COMPLIANT, CERAMIC, BGA-1023 |
| 文件頁數(shù)： | 52/130頁 |
| 文件大小： | 1493K |
| 代理商： | MC8641DVU1250HC |
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MPC8641 and MPC8641D Integrated Host Processor Hardware Specifications, Rev. 2
28
Freescale Semiconductor
DUART
Figure 7 provides the AC test load for the DDR bus.
Figure 7. DDR AC Test Load
7DUART
This section describes the DC and AC electrical specifications for the DUART interface of the MPC8641.
7.1
DUART DC Electrical Characteristics
Table 22 provides the DC electrical characteristics for the DUART interface.
7.2
DUART AC Electrical Specifications
Table 23 provides the AC timing parameters for the DUART interface.
Table 22. DUART DC Electrical Characteristics
Parameter
Symbol
Min
Max
Unit
High-level input voltage
VIH
2OVDD + 0.3
V
Low-level input voltage
VIL
–0.3
0.8
V
Input current
(VIN
1 = 0 V or V
IN = VDD)
IIN
—±5
μA
High-level output voltage
(OVDD = min, IOH = –100 μA)
VOH
OVDD – 0.2
—
V
Low-level output voltage
(OVDD = min, IOL = 100 μA)
VOL
—0.2
V
Note:
1. Note that the symbol VIN, in this case, represents the OVIN symbol referenced in Table 1 and Table 2.
Table 23. DUART AC Timing Specifications
Parameter
Value
Unit
Notes
Minimum baud rate
MPX clock/1,048,576
baud
1,2
Maximum baud rate
MPX clock/16
baud
1,3
Oversample rate
16
—
1,4
Notes:
1. Guaranteed by design.
2. MPX clock refers to the platform clock.
3. Actual attainable baud rate will be limited by the latency of interrupt processing.
4. The middle of a start bit is detected as the 8th sampled 0 after the 1-to-0 transition of the start bit. Subsequent bit values are
sampled each 16th sample.
Output
Z0 = 50 Ω
RL = 50 Ω
Dn_GVDD/2
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