參數(shù)資料
型號(hào)： MC80C32E-25P883
廠商： TEMIC SEMICONDUCTORS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, 25 MHz, MICROCONTROLLER, CDIP40
文件頁(yè)數(shù)： 9/392頁(yè)
文件大?。?/td> 6486K
代理商： MC80C32E-25P883
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106
2552K–AVR–04/11
ATmega329/3290/649/6490
The Output Compare Register A contains an 8-bit value that is continuously compared with the
counter value (TCNT0). A match can be used to generate an Output Compare interrupt, or to
generate a waveform output on the OC0A pin.
14.9.4
TIMSK0 – Timer/Counter 0 Interrupt Mask Register
Bit 1 – OCIE0A: Timer/Counter0 Output Compare Match A Interrupt Enable
When the OCIE0A bit is written to one, and the I-bit in the Status Register is set (one), the
Timer/Counter0 Compare Match A interrupt is enabled. The corresponding interrupt is executed
if a compare match in Timer/Counter0 occurs, i.e., when the OCF0A bit is set in the Timer/Coun-
ter 0 Interrupt Flag Register – TIFR0.
Bit 0 – TOIE0: Timer/Counter0 Overflow Interrupt Enable
When the TOIE0 bit is written to one, and the I-bit in the Status Register is set (one), the
Timer/Counter0 Overflow interrupt is enabled. The corresponding interrupt is executed if an
overflow in Timer/Counter0 occurs, i.e., when the TOV0 bit is set in the Timer/Counter 0 Inter-
rupt Flag Register – TIFR0.
14.9.5
TIFR0 – Timer/Counter 0 Interrupt Flag Register
Bit 1 – OCF0A: Output Compare Flag 0 A
The OCF0A bit is set (one) when a compare match occurs between the Timer/Counter0 and the
data in OCR0A – Output Compare Register0. OCF0A is cleared by hardware when executing
the corresponding interrupt handling vector. Alternatively, OCF0A is cleared by writing a logic
one to the flag. When the I-bit in SREG, OCIE0A (Timer/Counter0 Compare match Interrupt
Enable), and OCF0A are set (one), the Timer/Counter0 Compare match Interrupt is executed.
Bit 0 – TOV0: Timer/Counter0 Overflow Flag
The bit TOV0 is set (one) when an overflow occurs in Timer/Counter0. TOV0 is cleared by hard-
ware when executing the corresponding interrupt handling vector. Alternatively, TOV0 is cleared
by writing a logic one to the flag. When the SREG I-bit, TOIE0 (Timer/Counter0 Overflow Inter-
rupt Enable), and TOV0 are set (one), the Timer/Counter0 Overflow interrupt is executed. In
phase correct PWM mode, this bit is set when Timer/Counter0 changes counting direction at
0x00.
Bit
765
432
1
0
–
–OCIE0A
TOIE0
TIMSK0
Read/Write
R
RRRR
R
R/W
Initial Value
0
Bit
765
4321
0
–
–OCF0A
TOV0
TIFR0
Read/Write
R
RRRR
R
R/W
Initial Value
000
0000
0
相關(guān)PDF資料
PDF描述
MQ80C52EXXX-20/883:RD 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CQFP44
MR80C52CXXX-25SHXXX:RD 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CQCC44
MR80C154-20P883 8-BIT, 20 MHz, MICROCONTROLLER, CQCC44
M44C588-XXX-DIT 4-BIT, MROM, 4 MHz, MICROCONTROLLER, UUC
MC80C52EXXX-30 8-BIT, MROM, 30 MHz, MICROCONTROLLER, CDIP40
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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MC-80C32E-30-E 制造商:AIMTEC 制造商全稱:AIMTEC 功能描述:Rad. Tolerant 8-bit ROMless Microcontroller
MC80D21000G 制造商:COR 功能描述:RN
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MC80F0104B 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLERS
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