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參數(shù)資料
| 型號： | MC80C32E-25P883 |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 25 MHz, MICROCONTROLLER, CDIP40 |
| 文件頁數(shù)： | 344/392頁 |
| 文件大?。?/td> | 6486K |
| 代理商： | MC80C32E-25P883 |
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55
2552K–AVR–04/11
ATmega329/3290/649/6490
12.2
Register Description
12.2.1
EICRA – External Interrupt Control Register A
The External Interrupt Control Register A contains control bits for interrupt sense control.
Bit 1, 0 – ISC01, ISC00: Interrupt Sense Control 0 Bit 1 and Bit 0
The External Interrupt 0 is activated by the external pin INT0 if the SREG I-flag and the corre-
sponding interrupt mask are set. The level and edges on the external INT0 pin that activate the
interrupt are defined in Table 12-1. The value on the INT0 pin is sampled before detecting
edges. If edge or toggle interrupt is selected, pulses that last longer than one clock period will
generate an interrupt. Shorter pulses are not guaranteed to generate an interrupt. If low level
interrupt is selected, the low level must be held until the completion of the currently executing
instruction to generate an interrupt.
12.2.2
External Interrupt Mask Register – EIMSK
Bit 7 – PCIE3: Pin Change Interrupt Enable 3
When the PCIE3 bit is set (one) and the I-bit in the Status Register (SREG) is set (one), pin
change interrupt 3 is enabled. Any change on any enabled PCINT30..24 pin will cause an inter-
rupt. The corresponding interrupt of Pin Change Interrupt Request is executed from the PCINT3
Interrupt Vector. PCINT30..24 pins are enabled individually by the PCMSK3 Register.
This bit is reserved bit in ATmega329/649 and should always be written to zero.
Bit 6 – PCIE2: Pin Change Interrupt Enable 2
When the PCIE2 bit is set (one) and the I-bit in the Status Register (SREG) is set (one), pin
change interrupt 2 is enabled. Any change on any enabled PCINT23..16 pin will cause an inter-
rupt. The corresponding interrupt of Pin Change Interrupt Request is executed from the PCINT2
Interrupt Vector. PCINT23..16 pins are enabled individually by the PCMSK2 Register.
This bit is reserved bit in ATmega329/649 and should always be written to zero.
Bit
765
4321
0
–
ISC01
ISC00
EICRA
Read/Write
R
RRRR
R
R/W
Initial Value
000
0000
0
Table 12-1.
Interrupt 0 Sense Control
ISC01
ISC00
Description
0
The low level of INT0 generates an interrupt request.
0
1
Any logical change on INT0 generates an interrupt request.
1
0
The falling edge of INT0 generates an interrupt request.
1
The rising edge of INT0 generates an interrupt request.
Bit
7
654
32
10
PCIE3
PCIE2
PCIE1
PCIE0
–
–INT0
EIMSK
Read/Write
R/W
R
R/W
Initial Value
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MQ80C52EXXX-20/883:RD | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CQFP44 |
| MR80C52CXXX-25SHXXX:RD | 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CQCC44 |
| MR80C154-20P883 | 8-BIT, 20 MHz, MICROCONTROLLER, CQCC44 |
| M44C588-XXX-DIT | 4-BIT, MROM, 4 MHz, MICROCONTROLLER, UUC |
| MC80C52EXXX-30 | 8-BIT, MROM, 30 MHz, MICROCONTROLLER, CDIP40 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC-80C32E-30 | 制造商:AIMTEC 制造商全稱:AIMTEC 功能描述:Rad. Tolerant 8-bit ROMless Microcontroller |
| MC-80C32E-30-E | 制造商:AIMTEC 制造商全稱:AIMTEC 功能描述:Rad. Tolerant 8-bit ROMless Microcontroller |
| MC80D21000G | 制造商:COR 功能描述:RN |
| MC80F0104 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLERS |
| MC80F0104B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLERS |
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