參數(shù)資料
型號： MC68SZ328VH66V
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 66.32 MHz, MICROPROCESSOR, PBGA196
封裝： 12 X 12 MM, 0.80 MM PITCH, MAPBGA-196
文件頁數(shù)： 448/650頁
文件大小： 11130K
代理商： MC68SZ328VH66V
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Interrupt Services
MOTOROLA
USB Device Module
21-7
FRAME_MATCH—Match detected in USB_FRAME register. This interrupt asserts when the
frame number programmed into the MATCH field of the USB_FRAME register is the same as the
FRAME field of the USB_FRAME register.
CFG_CHG—Host changed USB device configuration. This interrupt indicates that the USB host
selected a different configuration or alternate interface. Software should read the USB_STAT
register to determine the current configuration and interface, and then reconfigure itself accordingly.
21.5.2 Endpoint Interrupts
The endpoint interrupts indicate requests for service by specific USB endpoints. All bits are maskable.
Each endpoint’s interrupt output is connected to a separate hardware interrupt line. When an event occurs
that causes an interrupt condition to occur, and the corresponding bit in the interrupt mask register is 0, an
interrupt signal will assert on the module’s interface. Writing a 1 to the associated bit in the interrupt
register clears the interrupt.
FIFO_FULL—This interrupt asserts when the FIFO is full.
FIFO_EMPTY—This interrupt asserts when the FIFO is empty.
FIFO_ERROR—This interrupt indicates that some abnormal condition occurred in the FIFO. The
cause of the error can be verified by reading the USB_EPn_FSTAT register associated with the
FIFO that had the error.
FIFO_HIGH—Each FIFO has an alarm register. This interrupt asserts if the byte count in the FIFO
is above the level specified by the alarm register.
FIFO_LOW—Each FIFO has an alarm register. This interrupt asserts if the byte count in the FIFO
is below the level specified by the alarm register.
EOT—End of Transfer. This interrupt asserts after the last data byte of a USB transfer crosses from
the USB device into the UDC module or vice versa. The end of a USB transfer is indicated by either
a zero byte packet or by a data packet shorter than the maximum packet size for the endpoint.
NOTE:
The EOT is never asserted at the same time as the DEVREQ interrupt for
setup packets. The EOT interrupt asserts after every interrupt packet
transfer, complete bulk data transfer, and data phase of control transfer.
The EOT interrupt will generally assert along with an EOF interrupt,
although an EOT interrupt without an EOF interrupt is possible if a transfer
terminated on a USB packet boundary.
DEVREQ—Device Request (Setup Packet). This interrupt indicates that the most recently received
packet was a setup or device request packet. Software on the USB device must decode and respond
to the packet in order to complete a Vendor, Class, or Standard request. This interrupt will only
assert for the control endpoint.
MDEVREQ—Multiple Device Request. This interrupt asserts when two or more setup packets
have been received before the DEVREQ interrupt was cleared. This interrupt is used to determine
when the USB host aborted a transfer in progress. In this case, the device receives a setup packet,
followed by a new setup packet before it completed processing the original command. This interrupt
only asserts for the control endpoint.
EOF—End of Frame. This interrupt indicates that an end of frame marker was sent or received on
the FIFO/UDC interface. This interrupt asserts if a DEVREQ is received. This interrupt asserts for
bulk, control, and interrupt data.
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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相關(guān)PDF資料
PDF描述
MC68VZ328CVF33V MICROCONTROLLER, PBGA144
MC68VZ328VF33VR2 MICROCONTROLLER, PBGA144
MC68VZ328VF33V MICROCONTROLLER, PBGA144
MC68VZ328CPV33V MICROCONTROLLER, PQFP144
MC88200RC25 32-BIT, MEMORY MANAGEMENT UNIT, CPGA180
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MC68VZ328AG 功能描述:微處理器 - MPU DRAGONBALL VZ PB-FR RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68VZ328AGR2 功能描述:微處理器 - MPU DRAGONBALL VZ PB-FR RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68VZ328CAG 功能描述:微處理器 - MPU DRAGONBALL VZ RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68VZ328CAGR2 功能描述:微處理器 - MPU DRAGONBALL VZ RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68VZ328CPV 制造商:FRESCL 功能描述:
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