參數(shù)資料
型號： MC68SC302
廠商： Motorola, Inc.
英文描述： 32-Bit Microprocessor(32位微處理器)
中文描述： 32位微處理器（32位微處理器）
文件頁數(shù)： 77/218頁
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代理商： MC68SC302
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Communications Processor (CP)
MOTOROLA
MC68SC302 USER’S MANUAL
4-31
INITIALIZE RX Command
This command initializes the Rx parameter RAM, clears the Rx memory chunk and forces
the SCC to enter the hunt mode. This command is expected in initialization before ENR
is set, and when busy interrupt is set.
4.5.10.6 HDLC ADDRESS RECOGNITION.
Each HDLC controller has five 16-bit registers
for address recognition: one mask register and four address registers (HMASK, HADDR1,
HADDR2, HADDR3, and HADDR4). The HDLC controller reads the frame's address from
the HDLC receiver, checks it against the four address register values, and then masks the
result with the user-defined HMASK. A one in HMASK represents a bit position for which
address comparison should occur; a zero represents a masked bit position. Therefore, to
receive all frames, set HMASK to $0000. Upon an address match, the address and the data
following are written into the data buffers.
NOTE
For 8-bit addresses, mask out the eight high-order bits in the
HMASK register.
Examples of 16- and 8-bit HDLC address recognition are shown in Figure 4-10
Figure 4-10. HDLC Address Recognition Examples
4.5.10.7 HDLC ERROR-HANDLING PROCEDURE.
The HDLC controller reports frame
reception and transmission error conditions using the channel BDs and the HDLC event
register. The modem interface lines can also be directly monitored in the SCC status
register.
Transmission Errors:
1. Transmitter Underrun. When this error occurs, the channel terminates buffer transmis-
sion, closes the buffer, sets the underrun (UN) bit in the BD, and generates the TXE
interrupt (if enabled). The channel will resume transmission after the reception of the
RESTART TRANSMIT command. The transmit FIFO size is four words.
2. GRANT Lost (Collision) During Frame Transmission. When this error occurs and the
channel is not programmed to control this line with software, the channel terminates
buffer transmission, closes the buffer, sets the Collision (COL) bit in the BD, and gen-
FLAG
$7E
ADDRESS
$68
ADDRESS
$AA
CONTROL
$44
ETC.
FLAG
$7E
ADDRESS
$55
CONTROL
$44
ETC.
HMASK
HADDR1
HADDR2
HADDR3
HADDR4
RECOGNIZES A SINGLE 8-BIT ADDRESS
(HADDR1)
HMASK
HADDR1
HADDR2
HADDR3
HADDR4
RECOGNIZES ONE 16-BIT ADDRESS (HADDR1) AND
THE 16-BIT BROADCAST ADDRESS (HADDR2)
$FFFF
$AA68
$FFFF
$AA68
$AA68
$00FF
$XX55
$XX55
$XX55
$XX55
8 BIT ADDRESS RECOGNITION
16-BIT ADDRESS RECOGNITION
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PDF描述
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參數(shù)描述
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MC68SEC000AA16R2 功能描述:微處理器 - MPU 8/16/32 BIT MPU STATIC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324
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