參數(shù)資料
型號(hào)： MC68HLC908QY2CDT
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16
封裝： TSSOP-16
文件頁數(shù)： 80/186頁
文件大?。?/td> 2765K
代理商： MC68HLC908QY2CDT
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Electrical Specifications
Data Sheet
MC68HLC908QY/QT Family — Rev. 2
170
Electrical Specifications
MOTOROLA
16.6 Control Timing
Figure 16-1. RST and IRQ Timing
Low-voltage inhibit reset, trip falling voltage (LVR)
VTRIPF
2.00
2.12
2.24
V
Low-voltage inhibit reset, trip rising voltage (LVR)
VTRIPR
2.04
2.18
2.30
V
Low-voltage inhibit reset/recover hysteresis
VHYS
—60
—
mV
Low-voltage detect, trip falling voltage (LVD)
VDTRIPF
2.20
2.32
2.44
V
Low-voltage detect, trip rising voltage (LVD)
VDTRIPR
2.21
2.33
2.45
V
Low-voltage detect reset/recover hysteresis
VDHYS
—10
—
mV
1. VDD = VDDMIN to VDDMAX, VSS = 0 Vdc, TA = TL to TH, unless otherwise noted.
2. Typical values reflect average measurements at VDD = 3.0 V, 25°C only.
3. Maximum is highest voltage that POR is guaranteed.
4. If minimum VDD is not reached before the internal POR reset is released, the LVI will hold the part in reset until minimum
VDD is reached.
5. RPU is measured at VDD = 3.0 V.
Characteristic(1)
Symbol
Min
Typ(2)
Max
Unit
Characteristic(1)
Symbol
Min
Max
Unit
Internal operating frequency
fOP (fBus)
—2
MHz
Internal clock period (1/fOP)tcyc
500
—
ns
RST input pulse width low
tRL
400
—
ns
IRQ interrupt pulse width low (edge-triggered)
tILIH
400
—
ns
IRQ interrupt pulse period
tILIL
Note(2)
—
tcyc
1. VDD >= 2.2 V, VSS = 0 Vdc; timing shown with respect to 20% VDD and 70% VDD unless otherwise noted.
2. The minimum period is the number of cycles it takes to execute the interrupt service routine plus 1 tcyc.
RST
IRQ
tRL
tILIH
tILIL
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
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