參數(shù)資料
型號: MC68HLC908JL3CFA
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, MICROCONTROLLER, PQFP48
封裝: LQFP-48
文件頁數(shù): 66/235頁
文件大?。?/td> 1497K
代理商: MC68HLC908JL3CFA
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Input/Output (I/O) Ports
Technical Data
MC68H(R)C908JL3E/JK3E/JK1E Rev. 1.0
158
Input/Output (I/O) Ports
MOTOROLA
When DDRAx is a logic 1, reading address $0000 reads the PTAx data
latch. When DDRAx is a logic 0, reading address $0000 reads the
voltage level on the pin. The data latch can always be written, regardless
of the state of its data direction bit.
12.3.3 Port A Input Pull-up Enable Register (PTAPUE)
The port A input pull-up enable register (PTAPUE) contains a software
configurable pull-up device for each of the seven port A pins. Each bit is
individually configurable and requires the corresponding data direction
register, DDRAx be configured as input. Each pull-up device is
automatically and dynamically disabled when its corresponding DDRAx
bit is configured as output.
PTA6EN — Enable PTA6 on OSC2
This read/write bit configures the OSC2 pin function when RC
oscillator option is selected. This bit has no effect for X-tal oscillator
option.
1 = OSC2 pin configured for PTA6 I/O, and has all the interrupt and
pull-up functions
0 = OSC2 pin outputs the RC oscillator clock (RCCLK)
PTAPUE[6:0] — Port A Input Pull-up Enable Bits
These read/write bits are software programmable to enable pull-up
devices on port A pins
1 = Corresponding port A pin configured to have internal pull-up if
its DDRA bit is set to 0
0 = Pull-up device is disconnected on the corresponding port A pin
regardless of the state of its DDRA bit
Address:
$000D
Bit 7
65432
1
Bit 0
Read:
PTA6EN
PTAPUE6 PTAPUE5 PTAPUE4 PTAPUE3 PTAPUE2 PTAPUE1 PTAPUE0
Write:
Reset:
000000
00
Figure 12-5. Port A Input Pull-up Enable Register (PTAPUE)
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PDF描述
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