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參數(shù)資料
| 型號(hào)： | MC68HC711E20CFU2 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 2 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | QFP-64 |
| 文件頁(yè)數(shù)： | 75/242頁(yè) |
| 文件大?。?/td> | 1672K |
| 代理商： | MC68HC711E20CFU2 |
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Electrical Characteristics
M68HC11E Family Data Sheet, Rev. 5.1
166
Freescale Semiconductor
10.13 Analog-to-Digital Converter Characteristics
Characteristic(1)
1. VDD = 5.0 Vdc ±10%, VSS = 0 Vdc, TA = TL to TH, 750 kHz ≤ E ≤ 3.0 MHz, unless otherwise noted
Parameter(2)
2. Source impedances greater than 10 k
affect accuracy adversely because of input leakage.
Min
Absolute
2.0 MHz
3.0 MHz
Uni
t
Max
Resolution
Number of bits resolved by A/D converter
—
8
—
Bits
Non-linearity
Maximum deviation from the ideal A/D transfer
characteristics
——
±1/2
±1
LS
B
Zero error
Difference between the output of an ideal and an
actual for 0 input voltage
——
±1/2
±1
LS
B
Full scale error
Difference between the output of an ideal and an
actual A/D for full-scale input voltage
——
±1/2
±1
LS
B
Total unadjusted
error
Maximum sum of non-linearity, zero error, and
full-scale error
——
±1/2
LS
B
Quantization
error
Uncertainty because of converter resolution
—
±1/2
LS
B
Absolute
accuracy
Difference between the actual input voltage and
the full-scale weighted equivalent of the binary
output code, all error sources included
——
±1
±2
LS
B
Conversion
range
Analog input voltage range
VRL
—
VRH
V
VRH
Maximum analog reference voltage(3)
3. Performance verified down to 2.5 V
VR, but accuracy is tested and guaranteed at VR = 5 V ±10%.
VRL
—
VDD +0.1 VDD +0.1
V
VRL
Minimum analog reference voltage(2)
VSS –0.1
—
VRH
V
VR
Minimum difference between VRH and VRL
(2)
3—
—
V
Conversion
time
Total time to perform a single A/D conversion:
E clock
Internal RC oscillator
—
32
—
tCYC+32
—
tCYC+32
tCY
C
s
Monotonicity
Conversion result never decreases with an
increase in input voltage; has no missing codes
—
Guaranteed
—
Zero input reading
Conversion result when VIn = VRL
00
—
Hex
Full scale
reading
Conversion result when VIn = VRH
—
FF
Hex
Sample
acquisition
time
Analog input acquisition sampling time:
E clock
Internal RC oscillator
—
12
—
12
—
12
tCY
C
s
Sample/hold
capacitance
Input capacitance during sample
PE[7:0]
—
20 typical
—
pF
Input leakage
Input leakage on A/D pins
PE[7:0]
VRL, VRH
—
400
1.0
400
1.0
nA
A
相關(guān)PDF資料 |
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