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參數(shù)資料
| 型號(hào)： | MC68HC711E20CFS3 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Microcontrollers |
| 中文描述： | 8-BIT, UVPROM, 3 MHz, MICROCONTROLLER, CQCC52 |
| 封裝： | WINDOWED, CERAMIC, LCC-52 |
| 文件頁(yè)數(shù)： | 182/268頁(yè) |
| 文件大?。?/td> | 3696K |
| 代理商： | MC68HC711E20CFS3 |
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Electrical Characteristics
Data Sheet
M68HC11E Family — Rev. 5
182
Electrical Characteristics
MOTOROLA
10.13 Analog-to-Digital Converter Characteristics
Characteristic
(1)
Parameter
(2)
Min
Absolute
2.0 MHz
3.0 MHz
Unit
Max
Max
Resolution
Number of bits resolved by A/D converter
—
8
—
—
Bits
Non-linearity
Maximum deviation from the ideal A/D transfer
characteristics
—
—
±
1/2
±
1
LSB
Zero error
Difference between the output of an ideal and an
actual for 0 input voltage
—
—
±
1/2
±
1
LSB
Full scale error
Difference between the output of an ideal and an
actual A/D for full-scale input voltage
—
—
±
1/2
±
1
LSB
Total unadjusted
error
Maximum sum of non-linearity, zero error, and
full-scale error
—
—
±
1/2
±
1/2
LSB
Quantization
error
Uncertainty because of converter resolution
—
—
±
1/2
±
1/2
LSB
Absolute
accuracy
Difference between the actual input voltage and the
full-scale weighted equivalent of the binary output
code, all error sources included
—
—
±
1
±
2
LSB
Conversion
range
Analog input voltage range
V
RL
—
V
RH
V
RH
V
V
RH
Maximum analog reference voltage
(3)
V
RL
—
V
DD
+0.1
V
DD
+0.1
V
V
RL
Minimum analog reference voltage
(2)
V
SS
–0.1
—
V
RH
V
RH
V
V
R
Minimum difference between V
RH
and V
RL(2)
3
—
—
—
V
Conversion
time
Total time to perform a single A/D conversion:
E clock
Internal RC oscillator
—
—
32
—
—
t
CYC
+32
—
t
CYC
+32
t
CYC
μ
s
Monotonicity
Conversion result never decreases with an
increase in input voltage; has no missing codes
—
Guaranteed
—
—
—
Zero input reading
Conversion result when V
In
= V
RL
00
—
—
—
Hex
Full scale
reading
Conversion result when V
In
= V
RH
—
—
FF
FF
Hex
Sample acquisition
time
Analog input acquisition sampling time:
E clock
Internal RC oscillator
—
—
12
—
—
12
—
12
t
CYC
μ
s
Sample/hold
capacitance
Input capacitance during sample
PE[7:0]
—
20 typical
—
—
pF
Input leakage
Input leakage on A/D pins
PE[7:0]
V
RL
, V
RH
—
—
—
—
400
1.0
400
1.0
nA
μ
A
1. V
DD
= 5.0 Vdc
±
10%, V
SS
= 0 Vdc, T
A
= T
L
to T
H,
750 kHz
≤
E
≤
3.0 MHz, unless otherwise noted
2. Source impedances greater than 10 k
affect accuracy adversely because of input leakage.
3. Performance verified down to 2.5 V
V
R
, but accuracy is tested and guaranteed at
V
R
= 5 V
±
10%.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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