參數(shù)資料
型號: MC68HC711D3MP2
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, OTPROM, 2 MHz, MICROCONTROLLER, PDIP40
封裝: PLASTIC, DIP-40
文件頁數(shù): 100/157頁
文件大小: 2252K
代理商: MC68HC711D3MP2
Central Processor Unit (CPU)
Instruction Set
MC68HC711D3 — Rev. 2
Data Sheet
MOTOROLA
Central Processor Unit (CPU)
47
LDAB (opr)
Load
Accumulator
B
M
B
B
IMM
B
DIR
B
EXT
B
IND,X
B
IND,Y
C6
D6
F6
E6
18
E6
ii
dd
hh
ll
ff
2
3
4
5
——
0—
LDD (opr)
Load Double
Accumulator
D
M
A,M + 1 BIMM
DIR
EXT
IND,X
IND,Y
CC
DC
FC
EC
18
EC
jj
kk
dd
hh
ll
ff
3
4
5
6
——
0—
LDS (opr)
Load Stack
Pointer
M : M + 1
SP
IMM
DIR
EXT
IND,X
IND,Y
8E
9E
BE
AE
18
AE
jj
kk
dd
hh
ll
ff
3
4
5
6
——
0—
LDX (opr)
Load Index
Register
X
M : M + 1
IX
IMM
DIR
EXT
IND,X
IND,Y
CE
DE
FE
EE
CD
EE
jj
kk
dd
hh
ll
ff
3
4
5
6
——
0—
LDY (opr)
Load Index
Register
Y
M : M + 1
IY
IMM
DIR
EXT
IND,X
IND,Y
18
CE
18
DE
18
FE
1A
EE
18
EE
jj
kk
dd
hh
ll
ff
4
5
6
——
0—
LSL (opr)
Logical Shift
Left
EXT
IND,X
IND,Y
78
68
18
68
hh
ll
ff
6
7
——
LSLA
Logical Shift
Left A
A
INH
48
2
——
LSLB
Logical Shift
Left B
B
INH
58
2
——
LSLD
Logical Shift
Left Double
INH
05
3
LSR (opr)
Logical Shift
Right
EXT
IND,X
IND,Y
74
64
18
64
hh
ll
ff
6
7
——
0
LSRA
Logical Shift
Right A
A
INH
44
2
——
0
LSRB
Logical Shift
Right B
B
INH
54
2
——
0
LSRD
Logical Shift
Right Double
INH
04
3
0
MUL
Multiply 8 by 8
A
B D
INH
3D
10
——
———
NEG (opr)
Two’s
Complement
Memory Byte
0 – M
MEXT
IND,X
IND,Y
70
60
18
60
hh
ll
ff
6
7
——
NEGA
Two’s
Complement
A
0 – A
AA
INH
40
2
NEGB
Two’s
Complement
B
0 – B
BB
INH
50
2
NOP
No operation
No Operation
INH
01
2
Table 3-2. Instruction Set (Sheet 5 of 8)
Mnemonic
Operation
Description
Addressing
Instruction
Condition Codes
Mode
Opcode
Operand
Cycles
S
X
H
I
N
Z
V
C
C
0
b7
b0
C
0
b7
b0
C
0
b7
b0
C
0
b7
b0
A
B
b7
b0
C
0
b7
b0
C
0
b7
b0
C
0
b7
b0
C
0
b7
b0
A
B
b7
b0
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PDF描述
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