參數(shù)資料
型號： MC68HC705RC17P
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, 2.097 MHz, MICROCONTROLLER, PDIP28
封裝： PLASTIC, DIP-28
文件頁數(shù)： 69/126頁
文件大?。?/td> 3079K
代理商： MC68HC705RC17P
MC68HC705RC17 — Rev. 2.0
General Release Specification
Resets
External Reset (RESET)
NON-DISCLOSURE
AGREEMENT
REQUIRED
Figure
5-2.
Reset
and
POR
Timing
Diagram
PCH
PCL
OSC1
2
RESET
INTERNAL
PROCESSOR
INTERNAL
ADDRESS
BUS
1
3FFE
3FFF
V
DD
4064
t CYC
t RL
INTERNAL
DATA
BUS
1
3FFE
NEW
PC
3FFF
NOTES:
1.
Internal
timing
signal
and
bus
information
are
not
available
externally.
2.
OSC1
line
is
not
meant
to
represent
frequency.
It
is
only
used
to
represent
time.
3.
The
next
rising
edge
of
the
internal
processor
clock
following
the
rising
edge
of
RESET
initiates
the
reset
sequence.
4.
V
DD
must
fall
to
a
level
lower
than
V
POR
to
be
recognized
as
a
power-on
reset.
5.
The
LPRST
pin
resets
the
CPU
like
the
RESET
pin.
However,
4064
POR
cycles
are
executed
first,
before
the
reset
vector
address
appears
on
the
internal
address
bus.
(See
.)
3
NEW
OP
CODE
PCL
PCH
NEW
PC
NEW
PC
OP
CODE
NEW
PC
CLOCK
1
0V
>
V
POR
4
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
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參數(shù)描述
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